大家好、
你好。
我代表客户发布此帖子、作为原始主题的延续。 他们想知道是否可以使用与下面的信号类似的时钟信号来驱动 ADS131A04?
如果是、会产生什么影响、如果有任何原因会影响下面的 PCB?
请注意、在较低频率下、脉冲看起来更好、请参阅下图。
这样的时钟是否会影响 ADS131A04的性能、因为它们不会降低 ADC 的性能。
期待您的帮助。
此致、
卡洛
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大家好、
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如果是、会产生什么影响、如果有任何原因会影响下面的 PCB?
请注意、在较低频率下、脉冲看起来更好、请参阅下图。
这样的时钟是否会影响 ADS131A04的性能、因为它们不会降低 ADC 的性能。
期待您的帮助。
此致、
卡洛
您好、Carlo、
感谢您为我们的 ADS131M0x 客户提供支持。
您在第一幅图像中显示的时钟的振幅有点过大。 数字输入的绝对最大额定值为 IOVDD + 0.3V、在最大 IOVDD 电源(3.9V)下不大于4.2V。 这个时钟看起来大约为5Vpp、所以我建议减小时钟振幅以避免损坏。
52.5%的占空比不应成为问题。 通常、我们指定的范围为40-60%、但 ADS131A04没有此类规格。 CLKIN 信号始终被某个比率分频、以在芯片中产生所有其他时序信号、因此主时钟输入的占空比变得比变得更加不重要。
较慢时钟的振幅似乎约为3.3Vpp (忽略过冲/下冲)。 我们通常不希望时钟信号看起来出现欠阻尼、因为它会将不必要的谐波引入相邻信号并通过接地进行耦合。 简单的 R-C 滤波器(10欧姆、10pF)有助于将其清理干净。
此致、