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[参考译文] ADS1258:了解 DRDY

Guru**** 2393835 points
Other Parts Discussed in Thread: ADS1258

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1010805/ads1258-understanding-drdy

器件型号:ADS1258

您好!

我 使用的是 ADS1258、对 DRDY 信号有疑问。 我有 四个 ADS1258、其中 SPI 接口全部位于同一总线上、使用芯片选择来读取每个接口。 我将 START 信号扇出到全部四 个 ADC、然后在接收 DRDY 时读取它们。 我的问题是、如果 ADC 芯片选择不是低电平、DRDY 是否会在 SCLK 的下降沿清除(恢复高电平)?  我提出的原因是、我需要知道我是否应该等待所有 ADC DRDY 信号、然后再读取每个信号。

 谢谢、

HSG  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    大家好、

    由于全部四个 ADC 同时开始转换、/DRDY 信号应在同一时间全部变为低电平(任何差异都是由于时钟源之间的不匹配造成的)。 您可以在读取数据之前等待所有四个/DRDY 信号变为低电平、或者仅监控其中一个/DRDY 信号、并添加一个小延迟以解决时钟频率的任何差异。

    此外、我的一位同事进行了测试、发现/DRDY 在第一个 SCLK 之后确实被驱动为高电平、即使/CS 保持高电平也是如此。

    布莱恩