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[参考译文] ADS4449：ADS4449数据时钟输出匹配

admin
Guru**** 2378650 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/882471/ads4449-ads4449-data-clock-output-matching

器件型号：ADS4449

您好！

在数据表的"输出时序"部分中有一个值"TSU (数据设置时间)"和"TH (数据保持时间)"的规格。 但是、注9指出、这些说明仅适用于相同的通道输出时钟。

我没有看到 CLKOUTAB 和 CLKOUTCD 之间温度范围内可能发生的最大相位差(或延时)规格。 这对于布置 FPGA 中的接收器侧时钟域非常重要。

假设 PCB 上的所有布线长度完全相同、因此我们可以忽略所有板级问题。

可以帮帮我吗？

此致

Marcus

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    TI__Guru**** 2378650 points
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    Marcus、

    我正在与设计团队核实此信息是否可用。 附件是我们发送给其他客户的一些信息、询问类似的问题。

    此致、

    Jim

    e2e.ti.com/.../ADS4449.docx

  • 0
    TI__Guru**** 2378650 points
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    您好！

    感谢您提供本文档、它有助于您了解数据表的含义。

    您是否有机会获得更多有关输入时钟和每个数据时钟之间传播延迟的数据？ 可能是有关温度关系的一些信息？

    这将大有帮助！

    谢谢、

    Markus

  • 0
    TI__Guru**** 2378650 points
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    Markus、

    下面显示了我能够获得的唯一其他信息。

    此致、

    Jim

    下表给出了从 CD 时钟上升到 AB 时钟上升(ns)(在250MSPS 下测量)的偏斜。

     

    温度、C

    DVDD、V

    -40

    25

    85.

    1.816.

    0.25.

    0.213

    0.077056

    1.916

    0.239

    0.202.

    0.065736

    2.016.

    0.2996

    0.203.

    0.045172.

    其他电源(AVDD3V 和 AVDD)分别保持在3.3V 和1.9V。

  • 0
    TI__Guru**** 2378650 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    谢谢、这正是我所需要的！