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[参考译文] ADS1292R:ADS1292电路

Guru**** 2560390 points
Other Parts Discussed in Thread: ADS1292, ADS1292R

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/902128/ads1292r-ads1292-circuit

器件型号:ADS1292R
主题中讨论的其他器件:ADS1292

大家好、我的项目几乎完成了。 有两个问题:

1.当我研究 ADS1292和 评估板的数据表时,我发现在某些电路中(请参阅图1示例)两个电容器并联,电容值有显著差异。 因此、我设计了原理图(也如图2所示)、移除了较小的电容器、因为较大的电容器允许一些容差。 这是正确的方法吗? 或两个并联电容器有什么用途? (消除电容器有助于实现小型化)。  

图1:

Figure 1

图2.

Figure 2移除较小的电容器。

2.我读出(我不记得源) ADS1292的 ADC 有内置的数字滤波器、可以根据采样率消除频率。 (例如、如果我以1KSPS 的速率进行采样、则会消除所有500Hz 以上的频率)如果我对500Hz 的截止频率使用1KSPS 的采样是可以的、因为具有较大滚降的简单抗混叠滤波器将允许一些频率通过? 目前、我计划在500Hz 频率下使用2KSPS 来防止混叠。 如果是这种情况、我可以以1KSPS 的速率进行采样。 此外、在50Hz FC 时、ADC 中是否有陷波滤波器?

提前感谢您

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    Harikishore、您好!

    我不建议移除较低值的电容器。 与较大的电容器相比、较小的电容器能够以更快的速度提供少量能量、这对于确保有效的启动例程非常重要。

    Δ-Σ 调制器不会消除频率、而是会将频率偏移得更高-超出采样频带。 如需更多详细 ΔΣ 信息、请参阅 ADS1292R 数据表的第8.3.4.3节 ADC Δ Σ 调制器。 50Hz 下没有陷波滤波器、因为您实际上希望在测量中存在该噪声、以便 RLD 可以消除该噪声。 我不建议为抗混叠滤波器设置如此激进的截止频率、因为您不希望测量受到影响。 (衰减在-3dB 点之前很长时间开始) 100KHz 左右的截止频率会更好。  

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    尊敬的 Alex、感谢您的详细解释。 如果截止频率设置为100kHz、8KSPS 的采样率将不符合奈奎斯特标准? 最大 AD 采样率为8KSPS。 如果我错了、请更正我。

    谢谢你

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    Harikishore、您好!

    很高兴能提供帮助!  

    我并不完全理解这个问题。 奈奎斯特标准与输入信号的采样率和频率有关。 其中采样率应至少是输入频率的2倍。 抗混叠滤波器不涉及这一点、只需将其设置为不影响输入信号的截止频率- 100kHz 应大于足以不影响输入信号的频率。