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器件型号：DAC3161 员工、
我们已将 TI DAC3161设计到 PCB 中、并以500MHz 的频率为器件计时、即最大指定采样率。 我的问题是： DAC3161在12个数字输入数据位之间相对于输入数据时钟的最大偏斜是多少？ 我搜索了数据表、找不到"偏移"一词。
我意识到 DAC3161能够通过写入数据表第16和17页中描述的寄存器来改变设置和保持时间、但这不是我的问题。 我需要知道 DAC3161本身上的 DAC 数据位偏斜程度、以便确定器件因 PCB 上的布线长度不匹配而承受的额外偏斜程度、并且在500MSPS 下仍能正常工作。 我们的板目前采用印刷电路板艺术品、日程安排很紧、因此我希望能迅速回答这个问题。 此致- Mike Amirault
