This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] DAC38RF82:在 RSETB 切换之前提供单端 DACCLK

Guru**** 2392095 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/821329/dac38rf82-providing-single-ended-dacclk-before-rsetb-togling

器件型号:DAC38RF82

您好!

 

我的客户希望使用单端 DACCLK。

但是、CLK_PLL_CFG 寄存器的 SEL_EXTCLK_DIFFSE 位的默认值为0 =差分。

数据表中的图141显示“为差分或单端时钟输入提供时钟”,然后显示“将 RESETB 引脚从低电平切换为高电平(建议脉冲持续时间>10us)”。

即使是默认值也是差分 DACCLK、在切换 RESETB 之前提供单端 DACCLK 真的是可以的?

DAC38RF8X 启动属性?

 

此致、

 

希拉诺

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Hirano、

    在您为系统加电并为 DAC 提供单端时钟后、您将对 DAC 发出硬复位。 在这之后、下一个命令将是写入 MISC 配置 寄存器0x31 以切换到单端时钟模式。 下一步是执行保险丝自动加载、然后执行剩余的寄存器写入。

    使用随附的配置文件、我能够使用 TI DAC EVM 对此进行测试。

    此致、

    Jim

    e2e.ti.com/.../se_5F00_test.cfg