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[参考译文] ADS5562:数据转换器论坛

Guru**** 2393725 points
Other Parts Discussed in Thread: ADS5562, ADS5560

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/816893/ads5562-data-converters-forum

器件型号:ADS5562
主题中讨论的其他器件: ADS5560

您好!

我们已在设计的电路板上测试了 ADS5562。

然后,我们遇到了作为附加文件的奇怪现象(请参考,粘贴在 Excel 文件上)  

我们观察到 ADC 输出交替显示大不相同的数据。

(2c81h、2d34h、2c7eh、2d36h、2c8ah、2d3ah… 作为数据的行)

与噪声电平纹波一样、奇数或偶数间隔信号也不是问题。  

首先、我们推断了误连接位对齐或 LVDS 输出抖动。

但我们没有发现错误、因为 输出信号可以清晰地跟踪输入信号。

接下来、我们还推断了周期性模拟输入 噪声。  

如果是这样、我认为它会更随机地发生变化、而不会定期发生变化。

看起来、同一芯片上存在两个 ADC、它们交替转换输入数据。

请告诉我们发生此类转换的原因。

谢谢、此致、

Kenjiro

   

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    Ken、  

    您能尝试重新发送 Excel 文件吗? 似乎链路已断开。 您能否重新陈述您看到的问题、以便我有一个清晰的理解。 从我可以看出、您似乎怀疑您从 ADC 接收到的代码是否有效? 您是否曾尝试获取数据的 FFT 以查看频谱是什么样的? 如果是、您也可以将其发送给我。 请帮助我更好地理解您看到的问题。  

    优素福

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    您好  、Yusuf - San、

    我再次附加了 PDF 文件。

    我采用了 LTC6363 (差分放大器)  作为 ADS5562和 Spartan-7的输入缓冲器、用于 ADS5562的数据处理。

    DDR 去串行化 IP 用于相互分离奇数数据和偶数数据、并将它们组合成16位数据。

    数据直接存储在双端口存储器中。

    然后、我在 DDR IP 和存储器之间进行了抽头、并通过 Vivado IDE FPGA 编译器中配备的逻辑分析仪检查信号。   

    我假设这些操作不会影响实际的16位数据。

    现在、输入和输出线性度作为宏视图是可以的。

    但是、相邻数据之间的数据跳跃是一种奇怪的现象、 它是作为噪声级别视图发生的。  

    谢谢、此致、

    Kenjiro

    e2e.ti.com/.../ADC_5F00_TEST.pdf

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    优素福-圣

    这是给您的第二封邮件。

    ADS5562是否采用交错 ADC 方法(芯片上配备了两个 ADC,并可交替激活)?

    因为 当采样频率为80MHz 时会生成40MHz 杂散(仅奈奎斯特频率)。

    该频率不会影响 SN 比率。

    如果是这样、我假设噪声直方图具有两个峰值分布形状、但数据表仅显示一个峰值正常分布形状。   

    我不是为什么。

    如果 采用交错方法、我可以理解这种现象。

    此 ADC 系列40MHz 版本的最后一位为 0 (ADS5560)、而80MHz 版本为2 (ADS5562)。  最后一位数字是否表示 ADS 的数量?

    谢谢你

    Kenjiro

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    Kenjiro、  

    为了回答您的问题、器件具有流水线架构、无需交错。 您在40MHz 时看到的噪声可能是因为可能启用了低频噪声校正(请参阅 数据表第26页的第7.3.1节"低频噪声抑制")。  然后、我有两条建议供您尝试。

    1.尝试通过启用下图所示寄存器中的位来试验低频噪声抑制功能。  

    另一个建议是尝试使用低频正弦波而不是直流、看看结果是否符合预期。  

    谢谢  

    优素福