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[参考译文] DAC3484:用作双路 DAC

Guru**** 2502205 points
Other Parts Discussed in Thread: DAC3484

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/801919/dac3484-use-as-a-dual-dac

器件型号:DAC3484

你好  

我的客户有一个应用需要在两个选项中工作:一个是1至100MHz (DAC 的直接输出)、另一个是100至1000MHz (DAC 输出使用 IQ 调制器进行升频转换)。

每次仅激活一个选项。 为此、我将使用 DAC3484并将 DAC 的 A/B 路由到低频输出、并将 DAC 的 C&D 路由到 IQ 调制器。  

是否可以关闭我不会每次使用的 DAC?  

我只想将数据写入两个 DAC 的 I use、以便在带宽的两倍中工作(如果我每次都必须写入4个 DAC、我会将数据速率降低一半)。 一

有可能吗? 配置是什么?  

谢谢

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    1.是的、可以将 DAC 输出驱动器设置为睡眠模式以节省功耗。 唤醒和睡眠时间大约为2us 的转换时间。 您可以使用以下寄存器来执行此操作

    2.是的、您可以通过 LVDS 总线将数据模式发送到总线 A 和总线 B (即第一个 I/Q 信号对)。

    我们有一个输出多路复用器级、可以将总线 A/B 数据复制到 DAC 内核 C/D 上。

    请注意、这是一个直接复制、因此 DAC 输出 A = DAC 输出 C、DAC 输出 B = DAC 输出 D。您不需要在 LVDS 总线中馈入总线 C 和总线 D 数据。

    只需设置 DAC_OUT_SEL (1:0)= 00、并且 DACD_OUT_SEL (1:0)= 01。

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    你(们)好

    感谢您的快速回复。

    那么、现在每个样本将是32位、而不是64位?

    请参阅随附的图片

    谢谢

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    您好!
    您必须对未使用的通道进行零填充、仍然是64位
    -Kang
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    这意味着、如果我想在 DAC 输出端保持相同的数据速率、我必须使 FPGA 到 DAC 的数据速率加倍?
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    你(们)好
    你的评论很笼统,我不确定我是否理解你的问题。 如果我理解正确、是的、DAC3484的 LVDS 总线被设计成交错、因此总线速度可以高于实际输入采样率。
    要在不使用通道 C 和 D 数据的情况下使用输入/输出多路复用器、您必须准确遵循图52上的图、并为通道 C 和 D 发送0。您无法更改输入数据格式的结构。
    -Kang