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[参考译文] ADS54J42：从 FPGA JESD204B PHY 接收&quot；SYNC 信号&quot 需要很长时间。

admin
Guru**** 2747375 points

Other Parts Discussed in Thread: LMK04828, DAC37J84, ADS54J42, ADS54J60

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/848584/ads54j42-takes-long-time-for-receiving-sync-signal-from-fpga-jesd204b-phy

器件型号：ADS54J42
主题中讨论的其他器件：LMK04828、 DAC37J84、 ADS54J60

您好！

我使用 ADS54J42 (512M)、DAC37J84 (256M)、LMK04828、Xilinx FPGA 制作了一个电路板。

长时间预热后、ADS54J42和 FPGA 之间的 SYNC 信号变为1。

然后、它在电路板断电和通电后正常工作。

我附加了我的配置文件。

谢谢你。

BH

ADC 复位
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lmk 0x02 0x00
lmk 0x100 0x78
lmk 0x101 0x55
lmk 0x103 0x00
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lmk 0x12C 0x00
lmk 0x12D 0x00
lmk 0x12E 0x79
lmk 0x12F 0x01
lmk 0x130 0x18
lmk 0x131 0x55
lmk 0x133 0x00
lmk 0x134 0x00
lmk 0x135 0x00
lmk 0x136 0x70
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lmk 0x14E 0x00
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lmk 0x151 0x02
lmk 0x152 0x00
lmk 0x153 0x00
lmk 0x154 0x78
lmk 0x155 0x00
lmk 0x156 0x7D
lmk 0x157 0x00
lmk 0x158 0x96
lmk 0x159 0x06
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lmk 0x140 0x00
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lmk 0x143 0x11
lmk 0x143 0x31
lmk 0x143 0x11
lmk 0x144 0xFF
lmk 0x139 0x3
lmk 0x100 0x60
lmk 0x108 0x6C
lmk 0x138 0x26
lmk 0x166 0x0
lmk 0x167 0x0
lmk 0x165 0x05
lmk 0x166 0x00
lmk 0x167 0x00
lmk 0x168 0x05
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DAC 0x00 0x01
DAC 0x00 0x0118
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DAC 0x53 0x0000
DAC 0x54 0x00FC
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DAC 0x56 0x0000
DAC 0x57 0x00FF
DAC 0x58 0x00FF
DAC 0x59 0x0000
DAC 0x5A 0x00FF
DAC 0x5B 0x00FF
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DAC 0x5E 0x0000
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DAC 0x64 0x0001
DAC 0x65 0x0001
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DAC 0x67 0x0001
DAC 0x68 0x7709
DAC 0x69 0x3504
DAC 0x6A 0x060D
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DAC 0x6C 0xF00F
DAC 0x6D 0x00DF
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DAC 0x6f 0x0000
DAC 0x70 0x0000
DAC 0x71 0x0000
DAC 0x72 0x0000
DAC 0x73 0x0000
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DAC 0x75 0x0000
DAC 0x76 0x0000
DAC 0x77 0x0000
DAC 0x78 0x0000
DAC 0x79 0x0000
DAC 0x7A 0x0000
DAC 0x7B 0x0000
DAC 0x7C 0x0000
DAC 0x7D 0x0000
ADC 复位
ADC 复位
ADC 复位
ADC 复位
ADC 复位
ADC 复位
ADC 置位
ADC 置位
ADC 置位
ADC 置位
ADC 置位
ADC 置位
lmk 0x127 0x66
ADC 0x4003 0x00
ADC 0x4004 0x68
ADC 0x60F7 0x01
ADC 0x4003 0x00
ADC 0x4004 0x68
ADC 0x6044 0x40
ADC 0x4003 0x00
ADC 0x4004 0x68
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ADC 0x4003 0x00
ADC 0x4004 0x68
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ADC 0x4003 0x00
ADC 0x4004 0x68
ADC 0x6052 0x81
ADC 0x4003 0x00
ADC 0x4004 0x68
ADC 0x6072 0x08
ADC 0x4003 0x00
ADC 0x4004 0x68
ADC 0x6000 0x01
ADC 0x4003 0x00
ADC 0x4004 0x68
ADC 0x6000 0x00
ADC 0x4003 0x00
ADC 0x4004 0x69
ADC 0x6001 0x39
ADC 0x4003 0x00
ADC 0x4004 0x69
ADC 0x6000 0x80
ADC 0x4003 0x00
ADC 0x4004 0x69
ADC 0x6006 0x0F
ADC 0x4003 0x00
ADC 0x4004 0x69
ADC 0x6007 0x08
ADC 0x4003 0x00
ADC 0x4004 0x69
ADC 0x6031 0x0A
ADC 0x4003 0x00
ADC 0x4004 0x69
ADC 0x6032 0x0A
ADC 0x4003 0x00
ADC 0x4004 0x6A
ADC 0x6016 0x00
lmk 0x127 0x06
lmk 0x100 0x78
DAC 0x4A 0x0F00
DAC 0x4A 0x0F1E
DAC 0x4A 0x0F1F
DAC 0x4A 0x0F01

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    BH、

    该器件的数据表已过期。 请下载当前 ADS54J60数据表、因为除了最大采样率外、这两个器件是相同的。 在这里、您会发现一些寄存器的位需要始终设置为"1"。 请确保将这些内容添加到寄存器写入中。

    加电和时钟出现后、配置 FPGA。 接下来、对 ADC 进行硬复位。 接下来配置 ADC 寄存器。 接下来让 FPGA 发送 SYNC 为低电平。 看看这是否有用。

    此致、

    Jim   

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    你好、Jim

    我没能在下面写。

    ADC 0x0000 0x81
    ADC 0x0011 0x80
    ADC 0x0059 0x20 //始终向位5写入1

    0x690016 0x80 //不需要写入，因为默认复位值为1。 但 我写了这个。

    但我们的板执行相同的操作。

    此致、

    BH

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    BH、

    您能否使用 Xilinx Chipscope 工具并验证 FPGA 是否正在发送 SYNC 低电平、然后 ADC 在下一个本地多帧时钟周期发送 K28.5字符？

    此致、

    Jim

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    您好、Jim

    我错过了 JESD PLL 复位(JESD 模拟页6A00、0x17位[6])。

    此致、  

    BH

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    BH、

    这是否解决了您的问题？

    此致、

    Jim

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    您好、Jim

    是的、我认为是这样。

    但我有疑问。

    使用 ADS54Jxx GUI 时、即使未执行 PLL 复位、也没有问题(我通过状态日志窗口对此进行了检查)。  

    但 ADS54J42数据表中的表66初始化序列描述了 PLL 复位。

    您认为应该执行 PLL 复位吗？

    此致、

    BH

     

  • 0
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    BH、

    我建议您执行此重置。

    此致、

    Jim