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[参考译文] LM98640QML-SP：SH 模式基准钳位和评估板接线

admin
Guru**** 2381280 points
Other Parts Discussed in Thread: LM98640CVAL
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/848319/lm98640qml-sp-sh-mode-reference-clamping-and-evaluation-board-wiring

器件型号：LM98640QML-SP
主题中讨论的其他器件：LM98640CVAL

大家好、我正在使用 LM98640CVAL 对 CCD 读数板进行原型设计(最终为定制设计)。 基准电平确实在 LSYNC 之后的每行输出(对于几个采样时钟持续时间)、因此我们推导出了一个外部钳位信号、该信号此时会变为高电平(电平超出 VCLP DAC 的控制范围、因此我无法手动设置)。 虽然在馈送4个视频信号(两个评估板和使用两个转换器)时、我们可以看到 A、B、C、D 列有一些显著的差异(尤其是两个板之间)。 我只是担心一些寄存器设置不正确(例如、VCLP 寄存器0x04的值是0x00还是0x40、还是该位无关紧要？)。 此外、我们是否需要调整电路板上的跳线(连接到 OS｛1、2｝+的 VCLP 引脚？ 我担心 的是、在通道1和2之间提供不需要的耦合、或者以其他方式偏置基准电平的捕获。 我是否期望单个芯片之间出现较大的增益/偏移差异？ 现在、我的所有设置(PGA 增益等)对所有设置都是通用的、但我看到大约1000个计数的"黑电平"存在差异。 这看起来很大。 有任何提示吗？

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    TI__Guru**** 2381280 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好！

    最熟悉此设备的应用工程师明天会返回办公室、届时我们将尝试回答您的问题。

    谢谢

    Christian

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    TI__Guru**** 2381280 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Martin：

    LM98640是一款用途广泛的器件、可支持多种不同类型的成像芯片、并以不同的模式工作。  LM98640CVAL 板旨在支持所有可能的不同工作条件、并具有许多不同的跳线和组件。   必须通过输入网络并在 适当的位置放置或移除跳线。  这应该足以获得良好的输入信号、但您也可以移除不必要的组件。  

    如果您不使用 VCLP DAC、则应将其断电并断开到输入端的跳线。

    对于相同的输入信号、您应该只能看到通道和器件之间的微小偏移。  根据设置的不同、我通常会看到低于10 LSB。  我看到读数偏移较大的最常见原因是没有正确设置钳位和采样窗口来捕获信号的平坦部分。

    有一个 GUI 可实现寄存器的轻松编程。  您可以从 TI.com 上的 LM98640CVAL 产品页面进行下载。   遗憾的是、它仅适用于 Windows XP 和更低版本、目前不适用于 Windows 7或10。

    为了进一步帮助您、我需要了解有关您的设置以及您如何使用该器件的更多详细信息。  例如、这种 CDS 模式还是 S/H 模式？   您的情况可能太复杂、无法通过 e2e 进行处理、因此我已向您发送朋友请求、您可以直接与我联系。  请注意、我将在周一至周三期间外出、但如果您给我发送一些消息、我仍会尝试在该期间作出回应。

    基尔比