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[参考译文] ADC12DJ3200EVM:配置 GUI 无法连接到 EVM

Guru**** 2579465 points
Other Parts Discussed in Thread: ADC12DJ3200EVM

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/611570/adc12dj3200evm-configuration-gui-is-not-able-to-connect-to-the-evm

器件型号:ADC12DJ3200EVM

您好!

我尝试启动并运行该板、但配置 GUI 无法检测到该板。  我已验证所有连接是否正确、计算机检测到 USB 设备、并且电源正常。  我按照以下故障排除建议、使用 FT_PROG 扫描了 FTDI 芯片:

在本例中、FT_PROG 读取:

如您所见、产品描述不是完全匹配。  如何继续?

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    您好 Patrick

    FT_PROG 返回的信息表明您拥有的 ADC12DJ3200EVM 是在产品发布之前发送给高级客户的初始修订版。

    我建议您与提供该板的 TI 人员合作、以获取最终生产板之一、该生产板将与您下载的 EVM GUI 软件配合使用。

    如果您需要在此期间继续、我可以提供指向其他 EVM GUI 安装程序的链接、该安装程序将与您拥有的电路板配合使用。

    您能否告诉我您拥有的 TSW14J5x 采集板型号和版本?

    此致、

    Jim B

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    很高兴能获得该安装程序、谢谢!  捕获板是 TSW14J56版本 D  

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    您好 Patrick

    这是您拥有的电路板的 ADC12DJ3200EVM GUI 安装程序。

    /cfs-file/__key/communityserver-discussions-components-files/73/3162.ADC12DJxx00EVM_5F00_GUI_5F00_Installer_5F00_S2P0_5B00_1_5D00_.zip

    您能否确认 ADC 板已标记为修订版 E3?

    您将需要.ini 文件才能将此板与您拥有的 TSW14J56EVM 配合使用。 如果您可以告诉我您要使用哪种 JMODE,我将发送适当的.ini 文件。

    此致、

    Jim B

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    谢谢! 电路板确实标有 E3。 现在、我正在设法使模式0启动并运行、但如果您有其他可用的器件、我很乐意让它们运行。
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    您好 Patrick

    好的、好的。

    以下是使用 TSW14J56修订版 D 启用该 E3板的.ini 文件

    /cfs-file/__key/communityserver-discussions-components-files/73/8875.TSW14J56_5F00_Rev_5F00_D_5F00_INI_5F00_Files_5F00_for_5F00_ADC12DJxx00E3_5B00_1_5D00_.zip

    将这些文件复制到以下文件夹位置:

    C:\Program Files (x86)\Texas Instruments\High Speed Data Converter Pro\14J56revD Details\ADC 文件

    下面是为支持该修订版 ADC EVM 而创建的快速入门指南:

    /cfs-file/__key/communityserver-discussions-components-files/73/4382.ADC12DJxx00EVM_5F00_E2_5F00_E3_5F00_Quick_5F00_Start_5F00_Guide_5F00_slau709_5B00_1_5D00_.pdf

    请注意、使用该 ADC EVM 和 TSW14J56 Rev D 时、JMODE0和 JMODE2支持的最大时钟速率将约为3GHz 或稍低。 在该速度以上、JESD204B 链路中存在与电路板相关的信号质量问题、这些问题会阻止数据采集。

    此致、

    Jim B

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    谢谢、我会尝试一下、如果我有任何问题、请告知您! 正如您所知、此器件是直接从 avnet.com 订购的、不是由任何 TI 人员提供的。
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    感谢您让我了解此 EVM 的来源。
    我将检查该问题、并确保他们使用生产版本更新任何旧库存。
    此致、
    Jim B
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    噪声流中似乎存在额外的杂散、这是输出应该是什么样的?

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    您好 Patrick

    在 JMODE0中、ADC 配置为4路交错器件。 4个交错内核之间的残余失调电压差异会导致 FS/4下的低电平杂散。

    本底噪声高于1GHz 到1.1GHz 之间的能量可能是由环境中的外部射频源耦合造成的。

    如果切换至 JMODE2 (2输入模式)、则每个 ADC 输入均由双向交错内核进行采样。 这将消除 Fs/4处的杂散。

    此致、

    Jim B

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    感谢你的帮助!  还有一件事、该器件看起来现在可以正常工作、但当我运行用户指南中描述的扫描(包括滤波射频信号)时:

    我获得的 SNR 和 dBFS 低于这一指标:

    在这里、两者都降低了大约8-10 dB。  如何降低谐波?  我使用的是 K&L 可调带通滤波器和 Rhode & Schwarz SMA 100 A 信号发生器。  

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    您好 Patrick

    该初始 EVM 具有 ADC 的预量产版本、其中不包括最终设计更改、以提高 FS/2-Fin 交错杂散性能。 我认为这是限制性能的主要因素。

    要确认这一点、您可以消除该杂散。

    1. 单击测试选项>陷波频率窗口
    2. 然后单击左侧筛选参数弹出窗口下方的复选框。 该频率根据在 HSDC 专业版主面板上输入的 ADC 输入目标频率在 FS/2-Fin 时自动计算。
    3. 然后单击确定关闭弹出窗口。 FS/2-Fin 杂散现在应该消失、并且生成的 SNR 和 SFDR 将被更新。

    完成后、请附上 HSDC Pro GUI 结果的快照。

    此致、

    Jim B

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    哦、这很有道理。  您建议从两侧卸下多少个纸槽?  我已附上1、2和3的屏幕截图。  它们在这一点上似乎是一种刺激。  

    这是否符合您的预期?

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    您好 Patrick
    当使用64k 样本大小时、我通常从5个单元开始。 FFT 看起来是合理的。
    您还可以增加滤波器参数对话框中的"谐波数量"条目、以识别折叠式插值转换器架构中显示的更多高阶谐波。 我会将其从5更改为10。
    此致、
    Jim B