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[参考译文] ADC12DJ3200EVM:RX 数据错误

Guru**** 2609285 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/672529/adc12dj3200evm-wrong-rx-data

器件型号:ADC12DJ3200EVM

你(们)好

我的系统配置为:

5GSPS、JMODE 0

Linerate 10Gbps、REFCLK 500MHz、内核:clk 250MHz、无扰频器、K=4、 我更改了 DB0-DB3通道的 RX¨极性

我用斜坡模式测试了系统、看起来正常。

我还尝试了 K28.5模式、它看起来也正常:

但在正常模式下、我认为我在 Rx 上获得了错误的数据、实际上我没有输入信号(偏移设置为20mV):

可能出了什么问题?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    你好,Tomas
    您使用的是哪种捕获平台? 这是基于 TI 提供的 FPGA 固件还是基于 FPGA 供应商 JESD204B IP 独立开发的固件?
    此致、
    Jim B
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    Jim
    感谢您的快速响应。 我正在使用 Digilent 板。 对于物理层、我使用 Xilinx 的 JESD204PHY;对于其他层、我使用我们公司的 FW (同事在 TI 使用较慢的 ADC 时不会出现任何问题)。 我将 ADC 设置为 K=4、在 PHY 层的 RX 数据中查找帧结束的超级按钮也有问题。
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好,Tomas

    我进一步审核了您的结果。 我看到、在所有 ADC 数据和测试模式中、您都得到了字符对齐、但没有帧对齐。 如果帧对齐正常、则斜升模式在被 JESD204B 弹性缓冲器重新对齐后将在所有通道中显示相同的情况。

    在实数数据输出模式下、我确实看到在每帧的末尾显示4个尾位的周期0、但这些位在各个通道之间不对齐。 对真实数据的进一步分析确实显示了接近中量程但存在一些偏移的数据。

    查看 GT2_Rx、我看到第二个完整数据组中出现了30次。 从下一个数据输出开始、我将得到以下结果:

    9429449419429410

    将这些值组合成12位值后、4个尾位将得到942h、944h、941h、942h、941h、之后是0。 这些十六进制值对应于大约2370个十进制值。 具有端接输入 且无偏移的标称值大约为2047d、因此存在一些偏移。

    显示十六进制数据的其他通道看起来类似、因此我认为一旦解决了帧对齐问题、一切都应该正常。

    请注意、关闭扰频功能后、帧末尾和多帧的重复尾位将触发 JESD204B 对齐字符插入。 如果您没有完全符合 JESD204B 接收器 IP 来处理这些字符、则插入的对齐 K 字符可能会导致问题。

    开启扰频将降低对齐字符的出现速率、但它们仍会显示。

    此致、

    Jim B