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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/687923/ads131e08-estimating-settling-time
从 ADS131E08数据表的图32可以看出、该 ADC 完全稳定的时间为3个采样周期(即1kHz 时为3ms)。 如果阶跃输入与 DRDY 脉冲同时发生、ADC 输入在1个或2个采样周期内稳定多少？
尊敬的 David： 感谢您发帖。 如果输入阶跃与转换周期同步、则可以预期下一个采样值约为最终值的20%、第二个采样值约为87%。 我们有一篇由我的一位同事撰写的关于此主题的博客文章-请看一下！ e2e.ti.com/.../delta-sigma-adc-digital-filter-types-sinc-filters此致、
