[参考译文] ADC12DJ3200：ADC12DJ3200可连接 Xilinx kintex UltraScale (KCU105)-数据提取

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Other Parts Discussed in Thread: ADC12DJ3200

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/720448/adc12dj3200-adc12dj3200-interfacing-with-xilinx-kintex-ultrascale-kcu105---data-extraction

器件型号：ADC12DJ3200

您好！

我有来自 JESD IP 的以下255：0数据流、有人能告诉我如何提取中的位进行采样。我正在使用 JMODE0

数据流：

80E2B78282DD778082FFF77D802CD87D81DBD78182EE477F8117A87D7F2F987E

2080E1977082DAA7908203F850802AF88081D9B7D082EE27A08115A8F07E30B8

此致、

Rajesh Khanna。

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7 年多前

0 admin 7 年多前

TI__Guru**** 2391415 points

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尊敬的 Rajesh：

我们实际上构建了一个固件参考设计、展示了如何在 JMODE0中将 Xilinx KCU105板与 ADC12DJ3200连接。您可以在 ADC12DJ3200工具文件夹的"软件"部分找到它、网址为：www.ti.com/.../toolssoftware。

请告诉我们这是否有帮助。

此致
Matthias

0 admin 7 年多前

TI__Guru**** 2391415 points

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您好、Matthias、

感谢您的支持、我想为您提供一个链接、我已经通过该链接进入了当前阶段。

e2e.ti.com/.../695011

我已经使用您的软件对电路板进行了测试(Xilinx 站点上的 Xilinx 位文件即 www.xilinx.com/member/jesd204_eval/uhwd_2016_3_v1_0.zip),it 正在工作、我不了解您站点中提供的固件存在一些问题的一些原因。我需要了解解析 JESD IP 数据以提取样本。我能够正确获得斜坡。

您的固件和 Xilinx 固件也存在问题、我认为需要交换处理的通道顺序、我想在解包时 HSDC 专业版中会否定这一点。

KCU105
TX	通道	FMC 夹层	FMC 基础	引脚映射	引脚映射
DA0	0	A10/A11.	DP3.	A4、A3	E4、E3 (DP0)
DA1.	1	C6/C7	DP0	E4、E3	D2、D1 (DP1)
DA2	2.	A6/A7	DP2.	B2、B1	B2、B1 (DP2)
DA3.	3.	A2/A3	DP1	D2、D1	A4、A3 (DP3)
DB0*	4.	B12/B13	DP7.	F2、F1	M2、M1 (DP4)
DB1*	5.	A14/A15	DP4.	M2、M1	H2、H1 (DP5)
DB2*	6.	B16/B17	DP6.	K2、K1	K2、K1 (DP6)
DB3*	7.	A18/A19	DP5.	H2、H1	F2、F1 (DP7)
*极性已交换				根据原理图	根据现场 TI 和 Xilinx 提供的设计