This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] DAC38RF93:寄存器的设置

Guru**** 657930 points
Other Parts Discussed in Thread: DAC38RF93
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/732286/dac38rf93-the-seting-of-register

器件型号:DAC38RF93

您好、 我在使用 DAC38RF93时遇到了一些需要解决的问题。

1、当我使用 DAC PLL 时、基准频率为500MHz、PLL-N=1、PLL_m=5、我选择低 VCO、如果我需要 VCO 输出、我想知道 PLL_VCO 值 I shoud 设置的值、将频率设置为6G?

2、在数据表第141页中,图167告诉我们,在我们通过读取寄存器地址"7F"获得位[15:11]=10000之前,我们无法操作寄存器,但是我得到的结果始终是"000000"。 我忽略了这个步骤、仍然配置寄存器、我觉得这个日期可以写入我需要的寄存器。 那么、我要说的是、是否存在任何问题?

3、我使用的采样率为3GHz、 84111 (具有2个 TX)、双路 DAC (具有信号链路)、我希望两个 DAC 漏斗独立工作的实际状态、DACA 为 Rx 0-3、DACB 为 RX4-7、 以下序列是寄存器 I 设置:

09:0003  0A:0610    OC:26A0  0D:8001 19:0001 20:4CCC 1F:CCCC 1E:CCCD 25:6600 27:1144  28:0440 09:0001 4A:0F03 09:0002 4A:F003 09:0003 4B:1300 4C:1303 4D:0100  4E:0F4F

在 FPGA 中 ,我设置 L=8,F=1,K=20,sysref 的频率为3.125M

但 我无法将 SYNC 信号置于高电平。 我的设置是否有任何问题。

谢谢!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好!

    如果您使用的是自己的电路板、而不是 TI EVM、则可以在仿真模式下使用 DAC38RF93 GUI 来生成和保存配置文件、以便用于配置电路板。 此外、在使用 FPGA 测试 DAC 之前、启用 DAC 内部的恒定数据和 NCO 以输出正弦波。 如果正常工作、它将控制已正确配置的 DAC。 启用恒定数据并从 DAC A 输出100MHz 正弦波的步骤如下:
    1)第1页、地址0x2F、位0 = 1 //启用近端数据
    2)第1页、地址0x30 = 0x3FFF //设置常量值
    3) Page1、地址0x0C=0x2622 //在路径 AB 上启用混频器和 NCO
    4) Page1、地址0x1E=0x4444
    Page1地址0x1F=0x4444
    Page1地址0x20=0x0444 //假设时钟为6GHz、将 NCO 频率设置为100MHz
    5) 5) Page1、地址0x28、位1 = 1
    Page1、地址0x28、位1 = 0//切换 SIF 同步

    谢谢、
    埃本
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    感谢您的回复。您能向我展示 DAC38RF93 GUI 的链接吗?我已经尝试找到,但失败了。 非常感谢
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    感谢您的建议。 我下载了 GUI 软件名称"slac722a",但没有 TI EVM。 软件无法打开。 您能否向我展示一下我的设计的寄存器值、其中我的工作参数如下:
    基准时钟:500m、PLL 使能、采样时钟= 6G、双路 DAC、1个 IQ 对、4通道、12个内插、LMFSHD:84111
    非常感谢!
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    随附"500m、PLL 使能、采样时钟=6G、双 DAC、1个 IQ 对、4通道、12个内插、LMFSHD:84111"的配置文件

    谢谢、

    埃本

    e2e.ti.com/.../DAC38RF93_5F00_6GHz_5F00_PLL_5F00_LMFS_5F00_8411_5F00_500M_5F00_ref.cfg

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    谢谢您的回复。 在配置文件中、
    第4页:
    0x3B = 0x9002
    0x3c = 0x8029
    0x3E =0x0929
    我们可以知道 MPY=0x14、RATE=01、SERDES_CLK_SEL=1、SERDES_REFCLK_DIV=2。 我有一些问题:
    1、表4中没有 MPY=0x14、您能解释一下通道速率与 MPY=0x14时的影响之间的关系吗?
    2、RATE = 01、因此 PLL 输出频率= 0.5*线路速率。 在上述系统中、线速率为5Gbps、因此 PLL 输出频率为2.5G、如何计算 DAC PLL 输出和 SERDES PLL 输出?之间的关系
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好)

    1) 1)我随附了一个更新的表。 这也将在下一版数据表中进行更正。

    2)串行器/解串器 PLL = MPY*(DAC PLL/4)/SERDES_REFCLK_DIV。

    SERDES_REFCLK_DIV 通过寄存器0x3B 位14:11进行编程

    谢谢、

    埃本

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    感谢您的回复。 我想知道最新版本和在互联网上发布的旧版本之间是否有其他区别。 您能否向我发送下一版本的数据表、其中已更正 miastakes!谢谢!
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好!

    我目前还不知道有任何其他更改、但我们所做的所有更改都将得到详细记录。

    谢谢、
    埃本
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您能解释一下寄存器页4、0x0a。 这个寄存器中提到了一些时钟、例如全速率、四分之一速率、havs、您能解释一下这些时钟与采样时钟或 SerDes 时钟之间的使用情况和关系吗?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好!

    这些时钟用于将数据从数字块切换至模拟块。 额外的详细信息不能公开。
    如果您必须提出与原始问题无关的另一个问题、请打开一个新主题。

    谢谢、
    埃本