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[参考译文] ADC12DJ3200:AD12DJ3200 (JMODE16) Xilinx FPGA 芯片示波器上的输入满量程

Guru**** 1649650 points
Other Parts Discussed in Thread: ADC12DJ3200EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1214568/adc12dj3200-input-full-scale-on-the-ad12dj3200-jmode16-xilinx-fpga-chipscope

器件型号:ADC12DJ3200

我想知道 AD12DJ3200 (JMODE16) Xilinx FPGA 芯片范围上输入满量程的数字值。

请检查是否在 ADC 设置或获取数字值中遗漏了任何东西。

1.设备:AD12DJ3200

  - JMODE 16 (双通道设置、但仅使用 B 通道、复数 I、Q)

  - FS_Range_A, FS_Range_B 寄存器: 0x2000(约500mVpp )

  - JESD204B 连接-无扰码-数据格式:二进制补码

  -禁用增益提升

2. FPGA:Xilinx xcku060

  -使用 JESD204 IP

  -通过 ChipScope 检查 ADC 输入完整电平(数字值)

  -输入波形:正弦波根据 ADC 数据表,将 ADC 输入电平( RF 输入)调整到大约500mVpp。

   检查 JMODE16中每个16位的 I 和 Q 输出、因为16位的 LSB 为 OVR_T、将其排除并添加"0"(I[15:1]和"0"、Q[15:1]和"0")、使其成为有符号16位值范围为+32767 ~-32768、

   当输入满刻度电平时、输出电压应该大约+32000 ~-32000。 但是、在实际输出中、大约有一半的值是输出的。

谢谢!

此致。

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    尊敬的 Lim:

    对于 ADC、您使用的是5200RF EVM 还是自己的电路板设计?

    THX:

    Rob

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    我正在使用我自己的设计。 但是、为了验证内容、使用 ADC12DJ3200EVM 执行了相同的测试、但结果与我们自己的设计相同。

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    尊敬的 Lim:

    两种器件都具有1Vpp 满量程输入能力。 这是预料之中的。

    此致、

    Rob

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    我明白你在说什么。 但是、此时我要使用500mVpp 的输入满量程。

    将 ADC 的输入满量程设置为0x2000并在 SG 处使用示波器检查500mVpp 后、SG 信号被输入到 ADC。
    在这种情况下、通过 Xilinx 芯片示波器输出的值应该接近-32768 ~+32767的满量程值、但我们确认它实际上是在其中大约1/2处输出的、这似乎是正确的。

    当设置为1Vpp 的满量程时、可在相同输入(500mVpp)下检查 Xilinx FPGA ChipScope 上的输出值为1/2。

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    尊敬的 Lim:

    您能解释一下吗? 使用示波器进行测量时、您在探测 ADC 的模拟输入引脚。

    如果是、请记住模拟输入是差分输入、因此对于1Vpp 满量程(默认)。 每个模拟输入引脚(AIN+和 AIN-)将具有+/-250mVpp 摆幅。

    这是您要测量的东西吗?

    此外、SG 是什么意思?

    此致、

    Rob