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[参考译文] DAC53004:即使使用0V、输出电压也在1.8V 饱和(使用 MOSFET 的强制检测配置)

Guru**** 1144750 points
Other Parts Discussed in Thread: DAC53004
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1208210/dac53004-out-voltage-saturates-at-1-8v-even-though-0v-is-asked-force-sense-configuration-with-mosfet

器件型号:DAC53004

您好!

我正在使用 DAC53004通过 MOSFET 的强制检测配置控制负载中的电流:

我们正在执行50us/250us 脉冲、中间大约20ms 的休息时间。 在休眠期间、0将发送到寄存器 DAC-X-DATA (19h、1Ah、1Bh、1Ch)。

增益为1.5、使用的基准为1.21V。

问题是、有时在其中一个通道输出中、我可以在休眠时间内看到1.8V 电压、而不是0V 电压。 由于某种原因、它会达到饱和。

这是我看到的。 蓝色表示 OUT1、粉色表示 FB1。 黄色表示 OUT0、绿色表示 FB0。

OUT0/FB0正是我所期望的、而 OUT1/FB1则是出现问题的答案。

你对此有什么解释吗?

此致、

Aur é lie.

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    您好、 Aur é lie:

    请分享一份完整的原理图以及所示每个通道上每个 FET 的电阻值。 您是否还可以对屏幕截图进行标记、以说明 DAC-0和 DAC-1数据何时更改为不同的值?  

    您说 OUT0/FB0是预期结果、但在复位期间 FB0不是0、这意味着通过负载的电流也不是0。 这是我们所期望的结果吗?  

    此致!

    Katlynne Jones  

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    尊敬的 Katlynne:

    原理图如下所示:

    下面是带标签的屏幕截图:

    OUT0和 OUT1引起的脉冲不会重叠、我们先是由 OUT1引起的脉冲、然后是由 OUT0引起的脉冲。

    此致、

    Aurelie

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    您好、 Aurelia、

    在原理图中、1300R 负载连接在何处?  

    此致!

    Katlynne Jones  

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    尊敬的 Katlynne:

    1300R 连接在 E1和 E2之间。

    此致、

    Aurelie

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    您好、 Aurelia、

    我了解。 因此、您将尝试更改流经负载的电流方向、具体取决于要脉冲的 DAC 通道。 是这样吗?  

    我在另一个响应中提到、任何一个通道的 OUTx 引脚都会进行调节 、以便 该通道的 FBx 引脚等于 DAC-X-DATA 寄存器中设置的设定点。 当 Q3关闭且通道1的9V 电压被移除时、 Q6上的漏极电压是多少?  移除 Q2后、Q5上的漏极电压是多少? FBx 两个电压都应该为0V、因此 电路中可能存在一些稳态响应、其中存在脉冲、导致 OUT0需要变化、但 OUT1保持恒定以 在 FBx 上实现所需的设定点。 这也可能是您在 OUT0上看到斜坡下降的原因。 当示波器图上的 OUT0=xx 和 OUT1=xx 时、您是要将每个通道的 DAC-X-DATA 寄存器设置为相同的值还是不同的值?  

    此致!

    Katlynne Jones