[参考译文] ADC34RF52：输入时钟规格

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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1258963/adc34rf52-input-clock-specifications

器件型号：ADC34RF52

您好！

您能解释一下 TI 对 ADC34RF52时钟输入的 VID (差分输入电压)的定义吗？该规格由制造商的

VID 是否从信号本身测量为 VOD、如下所示：

还是通过 ADC 差分放大器的测量结果、差分放大器在将输入信号相加时可以有效地使输出摆幅加倍：

我正在试着确定为了增加 LVDS 而应使用的升压变压器的比率、以便接近2.4 Vpp 的最大规格。

谢谢！

乔

2 年多前

0 admin 2 年多前

TI__Guru**** 2386620 points

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您好、Joe！

VID 将作为正负对之间的差值进行测量。您发布的第一张图片显示了这一点。

对于此器件、时钟应交流耦合并且在 ADC 侧自偏置、差分时钟输入的每一半应在移位 LVDS 共模周围具有最大1.2V 的摆幅。例如、如果您在每条差分线路上有一个0.8V 的共模、每条线路的摆幅应为 ±0.6V (0.2V 到1.4V)。这会在差分信号的一半上产生1.2Vpp 摆幅。由于差分对的每一半都是180°异相、因此在2.4Vpp 下、总差分电压将是此值的两倍。这是否有助于消除任何混淆？

此致、Chase

0 admin 2 年多前

TI__Guru**** 2386620 points

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谢谢、Chase。因此、在测量峰间值时、差分时钟信号的每一半必须等于或小于 CLKVDD (1.2V)。是这样吗？

0 admin 2 年多前

TI__Guru**** 2386620 points

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您好、Joe！

是的、如果按照时钟的最大输入电平运行、这是正确的。

我建议每个时钟桥臂上的时钟电平低于1.2V SE、而根据数据表、更大程度地符合典型的1Vpp 差分电压。

谢谢。

Rob

0 admin 2 年多前

TI__Guru**** 2386620 points

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大家好、Rob、我对尽可能提高时钟振幅感兴趣的主要原因是 TI 文章《时域中分析的时钟抖动、第3部分》。显示时钟振幅对 SNR 有显著的影响。

在本例中、我将对时钟性能特别敏感、因为我将以~500MSps 的速度对900 MHz 采样。

如果我将时钟的一半按到1.2V SE 最大值而不是0.5VSE (1Vpp Diff)电压、可能会出现问题吗？

谢谢。

乔

0 admin 2 年多前

TI__Guru**** 2386620 points

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您好、Joe！

只要低于时钟输入引脚上的绝对最大额定值、就应该没有问题。

最大程度地提高时钟的压摆率会有所帮助、但前提是时钟从一开始很干净。

我会尝试一些实验、并根据您的性能期望"拨入"正确的时钟振幅水平。

此致、

Rob

0 admin 2 年多前

TI__Guru**** 2386620 points

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这听起来不错。谢谢、Rob。是的、它非常干净(25fs)。

数据转换器（参考译文帖）

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