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您好!
我的客户尝试使用 FPGA 评估板测试 DAC39RF10EVM、但失败了。
请检查客户测试的以下两个 JESD204C/JESD204B 设置是否存在问题。
e2e.ti.com/.../DAC39RF10_5F00_8B10B_5F00_RegisterMap.xlsxe2e.ti.com/.../DAC39RF10_5F00_64B66B_5F00_RegisterMap.xlsx
谢谢你。
JH
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您好!
我的客户尝试使用 FPGA 评估板测试 DAC39RF10EVM、但失败了。
请检查客户测试的以下两个 JESD204C/JESD204B 设置是否存在问题。
e2e.ti.com/.../DAC39RF10_5F00_8B10B_5F00_RegisterMap.xlsxe2e.ti.com/.../DAC39RF10_5F00_64B66B_5F00_RegisterMap.xlsx
谢谢你。
JH
尊敬的 Lim:
我已经附加了一个配置文件以及一个针对具有6466b 编码的 JMODE 5 @ 8388.608MHz (64x 内插131.072MSPS)的屏幕快照。
8b10b 目前不工作。 我现在正在对其进行调试 、在有更新时通知您。
此致、
马特
e2e.ti.com/.../DAC39RF10_5F00_JMODE5_5F00_64b66b_5F00_8388.608GHz.log
您好、Matt。
我最近(昨天)确认我的 EVM 连接至 JMODE5和8B/10B (子类1和子类0)。
(请注意、由于公司规定、照片无法上传。)
但是、经过进一步测试、我发现 DAC 内的输入信号和信号不同。
我们确认、当 DAC 的 SFORMAT 设置为二进制或偏移二进制时、在 Jcap Mode2中反向读取。
例如、
如果将 DAC SFORMAT 设置为偏移我们确认当输入0x1000时读取0x9000,当输入0x9000时读取0x1000。 (在 JCAP 模式2下)
相反、如果 DAC SFORMAT 在输入0x1000时设置为2、则显示0x1000、输入0x9000时显示0x9000。 (同样在 Jcap 模式2下)
存在混淆。
如果 Offset 设置为二进制、则实际输入值读取为二进制。
如果设置为二进制、则实际输入值与偏移量类似。 (JCAP 模式2)
也请检查此部分。
此致。