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器件型号：ADC12DL3200 尊敬的诸位：
在一个新设计中、我们使用两个 ADC12DL3200来获得3个射频输入通道。 时钟频率
在2GHz 和3GHz 之间进行选择。
第一个 ADC 的 INA 和 INB 连接到射频输入通道、四条数据总线连接到 FPGA。
第二个 ADC 只有 INA 连接到射频输入通道、只有两条数据总线 连接到 FPGA。
为了仅设计一个 FW IP、我将使用相同的配置管理 ADC12DL3200。 两个 ADC 将是
已在双通道模式下配置、并且：
-在第一个 ADC 中,A 和 C 数据总线将管理 INA 样本,B 和 D 总线将
管理 INB 样本。
-在第二个 ADC 中,A 和 C 数据总线 将 管理 INA 样本 ,而 B 和 D 的所有线路
INB 输入的总线将是浮动的。
您是否认为第二个 ADC 正常工作？
你认为 我必须端接12+12+2差分线路悬空吗?
提前感谢。
此致、
丹尼尔
