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[参考译文] AFE881H1EVM:HART 数据传输问题

Guru**** 1630180 points
Other Parts Discussed in Thread: AFE881H1, AFE882H1
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1314610/afe881h1evm-issue-with-hart-data-transmission

器件型号:AFE881H1EVM
主题中讨论的其他器件:AFE881H1,, AFE882H1

您好、Joseph:

我们面临 HART 数据传输的问题。 我在下面给出了详细说明。

问题:大约每100个 HART 帧、尽管已通过 SPI 发送到 AFE881H1` FIFO_U2H_WR `寄存器、但在` HART_OUT `的前导码字节后不久就不会传输一个字节。

请参阅下面的示例 SPI 协议跟踪。 它`5个前导码字节、然后写入` FIFO_U2H_WR 的11个数据字节。

数据:h0E | h00、h00 | h00、h49 | h00、h4 |
h00、-申明 RTS 数据:hA0 | h04、h00 | h00 | h48 | hab、-读 alg_status

数据:h00 | h84、h00 | h40、h00 | h00 | h00 | hFB、数据: hA1 | h04、h00 | h00、h00 | h23 | hab、-阅读 GEN_STATUS
数据:h00 | h84、h00 | h40、h00 | h90、h00
| h02、数据:hA2 | h04、h00 | h00、h00 | hab、9E、-读取 MODED_STATUS 数据
: h00 | h84、h00 | h00、h00 | hb、
h00 | hf、数据:h2 | h04、h00 | h00、h00
| hab、-阅读调制解调器状态
数据:h00 | h84、h00 | h00、h00、h00 | hD9、h00 | hA1、数据: h9F | h04、h00 | h00、h00 | h00、hee |

hab、-读取 modem_status_mask 数据:h00 | h84、h00 | hFC、hab | hfA、h00 | hA0、数据:h1f | h04、hFC | h00、h00 | f9、hbC | hem_status_mask 数据:
h15 | h00、h01 | h00、hFF | h00、h84 | h00
、-写入 FIFO_U2H_WR 数据:h15 | h00、h01 | h00、hf | h00、h00
、h84 | h00、数据
:h15 | h00 | h01 | h00、h00 | h00、数据: h15 | h00、h01 | h00、hff | h00、h84 |
h00、数据:h15 | h00、h01 | h00、hff | h00
、h84 | h00、数据
:h15 | h00、h01 | h00、h00 | h00、h77 | h00、数据: h15 | h00、h00 | h00、h80 | h00、hb |
h00、数据:h15 | h00、h01 | h00、h77 | h00、-不在 hart_out 上传送

数据:h15 | h00、h00 | h00、h4 | h00、h93 | h00、数据: h15 | h00、h01 | h00、h00 | h00、h77 |
h00、数据:h15 | h00、h01 | h00、h0C | h00
、h53 | h00、数据
:h15 | h00、h00 | h00、hFE | h00、h96 | h00、数据: h15 | h00、h00 | h8 F | h00、hC6 | h00
、数据:h15 | h00、h01 | h00、h71 | h00、h27
| h00、数据
:h15 | h00、h01 | 6c、h05 | h00、h00 | h00、数据: h15 | h00、h00 | h00、h07 | h00、h77 | h00、 

在本例中、尽管已写入 U2H FIFO、前导码字节后的第三个字节值"0x00"仍不会在 HART_OUT 上传输。 以下波形是使用连接到 AFE881H1EVM 上 TP15的探针捕获的。  

此实施方案遵循 AFE881H1数据表"7.3.5.9使用 SPI 的 HART 通信"中的建议。

使 RTS 生效。 设置了 CTS_ASSERT 后、开始填充 FIFO_U2H。 将足够的数据排队到 FIFO_U2H 中、以填充高于设置阈值水平的 FIFO。

这一点值得注意、因为在置位 RTS 之前将数据写入 U2H FIFO 时不会发生错误(在成千上万个 HART 字符之后)。  

下面是一些可以消除的错误条件、它们是可能的原因。

  • `CRC_ERR`未设置
  • `FIFO_H2U_FULL_FLAG` IRQ 已启用且从不发生
  • `GAP_ERR`、`FRAME_ERR`、也不会在`Modem_STATUS`寄存器中设置` PARITY_ERR `位。  

硬件设置包括两块微控制器板和两块 AFE881H1EVM 板。 每个 AFE881H1EVM 的`HART_OUT`螺纹接线端子连接到另一个 AFE881H1EVM `HART_IN`螺纹接线端子。 一个微控制器充当 HART 主机、另一个微控制器充当 HART 器件、等待命令。 一个模拟发现2连接到器件端 AFE881H1EVM。  

下面提供了更多系统信息:

  • 配置为仅 SPI 模式的 AFE881H1
  • SCLK 频率1 MHz
  • RTS 输入引脚始终被驱动为高电平

我的初始问题是、为什么只有在将数据写入 U2H FIFO 之前置位 RTS 后才会出现此问题?

此致

阿莎 G

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    尊敬的 Asha:

    我们正在对此进行审查、并将很快作出答复。

    谢谢。
    卢卡斯

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    尊敬的 Asha:

    很抱歉,我没有及时回应。

    为了理解您发布的表、您是否在调制解调器状态掩码寄存器中写入0x00F9? 如果希望 FIFO_U2H_FULL 置位、则需要0x00D9。

    如果上述操作不起作用:
    您是否可以尝试增加消息的前导码大小、并查看输出或错过的字节是否发生了变化? 我正在尝试完全排除 H2U FIFO 已满的情况。 由于每次测试都会丢失相同的字节、因此这是我目前怀疑的情况。

    我不确定 RTS 为什么会导致您的测试结果出现差异。 我假设您仅使用 SW RTS 位、而不使用引脚?

    谢谢。
    卢卡斯

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    您好、Lucas:

    同一字节并不是每次都丢失。 每次测试中都观察到缺少不同字节。

    会尝试自己的方法、让您知道。

    谢谢

    阿莎 G

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    您好、Lucas:

    还有一项更新:我们使用连接到3.3V 的 SW RTS 位和 HW RTS 引脚。

    此致

    阿莎 G

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    尊敬的 Asha:

    感谢您的更新和更正。

    当您有机会查看我的建议时、请告诉我。

    谢谢。
    卢卡斯

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    您好、Lucas:

    选项1:  将0x00D9写入调制解调器状态掩码寄存器。

    它不起作用。

    选项2: 增加报文的前导码大小

    正在进行测试。 我很快就会更新

    阿莎 G

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Asha:

    我忘记问您是监视 ALARM 引脚还是在丢失字节后读取调制解调器状态寄存器。

    如果屏蔽了特定的警报、它仍然应该更新调制解调器状态寄存器、只是不会影响 ALARM 引脚。

    谢谢!
    卢卡斯

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Lucas:

    查看下面的最新 SPI 片段。 还附加了更大的 SPI 跟踪、 0x01_MissingSpi.txt。 在此示例中、6个前导码字节之后的第二个数据字节0x01不会出现在 HART_OUT 上。 FIFO_U2H_FULL_FLAG IRQ 已启用、并且未发生。  

    我通过填充 U2H FIFO 来分别确认 FIFO_U2H_FULL_FLAG IRQ 检测机制的作用。  

    数据:h1f | h04,he0 | h00,hdf | hh00,hb5 | hab:write modem_status_mask = 0xE0DF:GAP_ERR,FRAME_ERR,PARITY_ERR,FIFO_H2U_LEVEL_FLAG,FIFO_HGU_FULL_FLAG FIFO_U2H_FULL_FLAG
    数据:h15 | h00、h01 | h00、hFF | h00
    、h84 | h00、数据:h15 | h00 | h00、hf | h00、h00
    、h84 | h00、数据:h15 | h00、h01 | h00、hFF | h00、h84 | h00、数据:
    h15 | h00、h01 | h00、hff | h00、h84 |
    h00、数据:h15 | h00、h01 | h00、hff
    | h00、h84 | h00、数据
    :h15 | h00、h01 | 84、hff | h00、h00、数据: h15 | h00、h01 | h00、h00 | h00、h77 |
    h00、数据:h15 | h00、h00 | h00、h01 | h00、h65
    | h00、:00、h00
    :h15 | h00、h00 | h02 | h00、h6C |数据: h15 | h00、h01 | h00、h03 | h00、h7E |
    h00、数据:h15 | h00、h00 | h00、h04
    | h00、h7E | h00、数据
    :h15 | h00、h01 | h00、h05 | h00、h6C | h00、数据: h15 | h00、h01 | h00、h06 | h00、h65 |
    h00、数据:h15 | h00、h00 | h07 | h00、h77
    | h00、数据
    :h15 | h00、h00 | h00、h08 | h00、h5A | h00、数据: h1f | h00、he0 | h00、h9F | h00、h72 |
    h00、数据:hA0 | h04、h00 | h00、h00
    | h48 | hab、数据:h00 | h84、h00 | h40、h00 | h00 | hFB:阅读 alarm_status = 0x4000:modem _IRQ 数据:
    ha1 | h04,h00 | h00,h00 | h23 | hab,
    数据:h00 | h84,h00 | h40,h00
    | h90,h00 | h02:read gen_status = 0x4090:MODEM_IRQ, SR_BUSYn, PVDD_HI
    数据:hA2 | h04,h00 | h00 | h00 | h00 | h00 |数据: h00 | h84,h00 | h00,h00 | hc9,h00 | h1:读 MODEM_STATUS = 0x00C9:FIFO_HGU_EMPTY_FLAG 

    查看下面的最新 SPI 片段。 还附加了更大的 SPI 跟踪、 0x01_MissingSpi.txt。 在此示例中、6个前导码字节之后的第二个数据字节0x01不会出现在 HART_OUT 上。 FIFO_U2H_FULL_FLAG IRQ 已启用、并且未发生。  

    我通过填充 U2H FIFO 来分别确认 FIFO_U2H_FULL_FLAG IRQ 检测机制的作用。  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Asha:

    我正在评论该内容、很快就会回复您。

    谢谢。
    卢卡斯

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    Asha:


    我一直在评论这篇文章,我仍然不知道什么可能是错误的。 出于好奇心、在您写入 FIFO 以进行传输时、您是填充整个 FIFO 并检查 FIFO U2H FULL_FLAG、还是在 FULL_FLAG 低于 FULL 时使用 U2H_LEVEL_SET 检查 LEVEL_FLAG? 我将检查如果您使用 U2H_LEVEL_SET 而不完全填满缓冲区、会发生什么情况。 如果您当前使用 level_set、则可以检查是否看到不同的值会导致问题变好或变差。

    另一种方法是增加一些开销、并尝试在写 FIFO 之间读取 FIFO 级别。 如果您可以通过传输中的每个字节记录 FIFO_STATUS 中的 FIFO 级别、那么您可能会发现发生此问题时是否有特定的 FIFO 级别。


    约瑟夫·吴

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    您好、Joseph:

    新证据显示寄存器回读 MODEM_STATUS_MASK 与写入的数据不匹配。  

    好示例:寄存器写入仍然存在

    数据:h1f | h:00, he0 | hing, hf, hhh0, hc5 | h00
    ,--将0xE0CF 写入 MODE_STATUS_MASK 数据:h9F |
    h00、h00 | h00、h00、h00 | h00 | hh、hh、h00 | hh、hh、h00 | hh、hh、h00 | hh、hh、hh、hh、hh、hh -值= 0xE0CF
    

    错误示例:寄存器写入不持续

    数据:h1f | hing,he0|hing,hhhf|hing,hc5|hing,h0,--将0xE0CF 写入 MODE_STATUS_MASK
    数据:h9F
    | hing,h00 | hing,h00 | hhhhhe|hhhe|hhhhhhing,--读 MODE_STATUS_MASK 数据:h00|h80,h0,h0,5B | hh0,hhh00 -值= 0xE0DF
    

    附加了较大的 SPI 跟踪、 ModemStatusMaskMiscompare.txt

    AFE881H1的 SPI 状态位指示上述两种情况下均无错误。  

    上述写入失败似乎只是在 HART 发送/接收工作负载期间重复发生。 在没有进行任何其他操作的情况下、简单地写入和读取 MODE_STATUS_MASK 寄存器并未在进行数千次写入后产生不匹配的结果。  

    上一个相关寄存器 FIFO_U2H_WR 是仅写入的、但可能会发生类似的写入失败、从而导致数据丢失。

    什么原因可能导致对 MODEM_STATUS_MASK 的写入失败?

    Data: h00 | h84, h00 | h21, h00 | h00, h00 | h1B, 
    Data: hAA | h04, h00 | h00, h00 | h00, hCF | hAB, 
    Data: h00 | h84, h00 | h20, h00 | h01, h00 | h09, 
    Data: hAA | h04, h00 | h00, h00 | h00, hCF | hAB, 
    Data: h00 | h84, h00 | h10, h00 | h02, h00 | hF9, 
    Data: hAA | h04, h00 | h00, h00 | h00, hCF | hAB, 
    Data: h00 | h84, h00 | h11, h00 | h03, h00 | hEB, 
    Data: hAA | h04, h00 | h00, h00 | h00, hCF | hAB, 
    Data: h00 | h84, h00 | h00, h00 | h04, h00 | hBC, 
    Data: hAA | h04, h00 | h00, h00 | h00, hCF | hAB, 
    Data: h00 | h84, h00 | h02, h00 | h04, h00 | h96, 
    Data: h1F | h04, hE0 | h00, hDF | h00, hB5 | hAB, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h0A, h00 | h17, 
    Data: h15 | h00, h01 | h00, hFF | h00, h84 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h08, h00 | h19, 
    Data: h15 | h00, h01 | h00, hFF | h00, h84 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h18, h00 | h69, 
    Data: h15 | h00, h01 | h00, hFF | h00, h84 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h18, h00 | h69, 
    Data: h15 | h00, h01 | h00, hFF | h00, h84 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h28, h00 | hF9, 
    Data: h15 | h00, h01 | h00, hFF | h00, h84 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h28, h00 | hF9, 
    Data: h15 | h00, h01 | h00, hFF | h00, h84 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h38, h00 | h89, 
    Data: h15 | h00, h00 | h00, h02 | h00, h6C | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h38, h00 | h89, 
    Data: h15 | h00, h00 | h00, h80 | h00, hEB | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h48, h00 | hDE, 
    Data: h15 | h00, h01 | h00, h00 | h00, h77 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h48, h00 | hDE, 
    Data: h15 | h00, h01 | h00, h00 | h00, h77 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h58, h00 | hAE, 
    Data: h15 | h00, h01 | h00, h82 | h00, hF0 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h58, h00 | hAE, 
    Data: h15 | h00, h01 | h00, h00 | h00, h77 | h00, 
    Data: h0E | h00, h00 | h00, h49 | h00, hD4 | h00, 
    Data: h1F | h00, hE0 | h00, hCF | h00, hC5 | h00, 
    Data: h9F | h00, h00 | h00, h00 | h00, hEE | h00, 
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    Data: hA0 | h04, h00 | h00, h00 | h00, h48 | hAB, 
    Data: h00 | h84, h00 | h40, h00 | h00, h00 | hFB, 
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    Data: h9F | h04, h00 | h00, h00 | h00, hEE | hAB, 
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    Data: h0E | h00, h00 | h00, h48 | h00, hD3 | h00, 
    Data: h1F | h00, hE0 | h00, hDB | h00, hA9 | h00, 
    Data: h9F | h00, h00 | h00, h00 | h00, hEE | h00, 
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    Data: h00 | h84, h00 | h40, h00 | h00, h00 | hFB, 
    Data: hA1 | h04, h00 | h00, h00 | h00, h23 | hAB, 
    Data: h00 | h84, h00 | h40, h00 | h90, h00 | h02, 
    Data: hA2 | h04, h00 | h00, h00 | h00, h9E | hAB, 
    Data: h00 | h84, h00 | h00, h00 | hDF, h00 | hB3, 
    Data: h9F | h04, h00 | h00, h00 | h00, hEE | hAB, 
    Data: h00 | h84, h00 | hE0, h00 | hDB, h00 | hEC, 
    Data: h1F | h04, hE0 | h00, hDF | h00, hB5 | hAB, 
    Data: h1F | h00, hE0 | h00, hDB | h00, hA9 | h00, 
    Data: h9F | h04, h00 | h00, h00 | h00, hEE | hAB, 
    Data: h00 | h84, h00 | hE0, h00 | hDB, h00 | hEC, 
    Data: hA0 | h04, h00 | h00, h00 | h00, h48 | hAB, 
    Data: h00 | h84, h00 | h40, h00 | h00, h00 | hFB, 
    Data: hA1 | h04, h00 | h00, h00 | h00, h23 | hAB, 
    Data: h00 | h84, h00 | h40, h00 | h90, h00 | h02, 
    Data: hA2 | h04, h00 | h00, h00 | h00, h9E | hAB, 
    Data: h00 | h84, h00 | h00, h00 | hD6, h00 | h8C, 
    Data: h9F | h04, h00 | h00, h00 | h00, hEE | hAB, 
    Data: h00 | h84, h00 | hE0, h00 | hDB, h00 | hEC, 
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    Data: h00 | h80, h00 | h02, h00 | h48, h00 | hDE, 
    Data: h15 | h00, h01 | h00, h00 | h00, h77 | h00, 
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    Data: h00 | h80, h00 | h02, h00 | h58, h00 | hAE, 
    Data: h15 | h00, h01 | h00, h82 | h00, hF0 | h00, 
    Data: hAB | h00, h00 | h00, h00 | h00, hA4 | h00, 
    Data: h00 | h80, h00 | h02, h00 | h58, h00 | hAE, 
    Data: h15 | h00, h01 | h00, h00 | h00, h77 | h00, 
    Data: h0E | h00, h00 | h00, h49 | h00, hD4 | h00, 
    Data: h1F | h00, hE0 | h00, hCF | h00, hC5 | h00, 
    Data: h9F | h00, h00 | h00, h00 | h00, hEE | h00, 
    Data: h00 | h80, h00 | hE0, h00 | hDF, h00 | h5B, 

    此致

    阿莎 G

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Asha:


    此时、我想不出任何无法写入寄存器的情况。 只是为了确保我理解、我们来看看这样一个情况、即 MODE_STATUS_MASK 写入没有被写入。

    看起来写入从0x1F 0xE0 0xCF 0xC5开始。 最后一个字节代表正确的 CRC 字节。 下一行显示为0x9F 0x00 0x00 0xEE。 这是从1F 寄存器读取的开始、也是使用正确的 CRC 字节。 下一行提示从器件实际读回。 写入操作再次为0x00 0x00 0x00 0x00、写入的最后一个字节为 CRC。

    从 NOP 回读为0x80 0xE0 0xDF 0x5B。 此处读取的数据是0xE0DF、而不是本应写入的0xE0CF 字节。 不过、0x5B 是针对0xE0DF 意外字节的正确 CRC、这意味着原始写入操作没有完成(尽管已完成所有 CRC 校验)。

    我想、这是您在上一篇文章中放置的代码。 第998行将0xE0CF 写入寄存器、第999行使用0x9F 开始读取、第1000行显示了使用0xE0DF 执行的错误读取。

    如果不进行998写入、寄存器将保留先前写入的值、即来自行960的值、这似乎确认了之前的值0xE0DF。

    我不确定问题可能在这里有什么。 只有在发送和接收 HART 时才会发生这种情况吗? 您知道这是其中之一吗? 此时、我不知道可能发生这种情况的任何情况、因此我想尽可能多地了解这个问题。 我想说明的是、我们已经使用此器件完成了 HART 测试、并且通过了 DLL039超时应力测试、且未出现通信故障。

    我需要与其他一些工程师核实、看看我是否漏掉了任何东西。 此时、我想不出任何会导致此类问题的东西。


    约瑟夫·吴

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    Asha:


    我仍在检查这个。 与此同时、您能否验证您用于 AFE881H1的 SPI 时序? 这将是第6.6节中的时序要求表以及图6-1中的图表。 如果违反时序、可能会产生一些异常结果。

    此外、您可以展示一个32位传输图吗? 与/CS、SCLK、DIN 和 DOUT? 我只是想看看你的信号是什么样子。


    约瑟夫·吴

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    Asha:

    此外、您使用什么来记录数字数据? 您是否能够使用它触发示波器、以便在 SPI 传输传入时读取该传输?

    约瑟夫·吴

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    Asha:

    另一项需要检查的是导致错误的 SPI 传输。 首先、我要确保 CRC 可以触发警报来指示发生了传输错误。 其次、我会检查一下如果/CS 在传输过程中提前释放、是否存在任何可能性。 如果在/CS 再次上升时、SPI 数据传输未完成、则将不会获得完整的 SPI 帧。 我不确定不完整的帧会触发错误以设置警报。

    约瑟夫·吴

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    您好、Joseph:  

    我与 Asha 合作解决这个问题。 我 会先发布一些最新的发现、然后回复您的未决问题。  

    最近的调查结果

    通过 SPI 被忽略的寄存器写入操作与 U2H FIFO 状态之间存在相关性。  

    首先、我通过运行内部回送测试(MODEM_CFG)来验证系统(AFE881H1EVM +微控制器)的稳定性。 DUPLEX = 1)。 以下序列通过了130,000次迭代、失败率为0。  

    1. 用1个前导码字节填充 U2H FIFO、然后填充1到31个随机模式字节
    2. 通过 设置`Modem_CFG`的第0位来使 RTS 生效
    3. 允许 HART 数据传输的延迟:(833us)*(每个 HART 字符11位)*(HART 字符数)
    4. 通过清除`Modem_CFG`的位0、使 RTS 无效
    5. 清空 H2U FIFO 并确认所有非前导码字节都已接收、没有额外的字节

    然后、我重现了间歇性问题、即如果先确认 RTS、则不能通过 HART 传输数据字节。 与上面的序列相同、但交换了步骤1和2。 该问题每隔几百次循环迭代便重现。  

    然后、我又重现了间歇性 问题、如果正在进行 HART 传输、则会忽略不相关的寄存器写入。 流程:

    1. 通过 设置`Modem_CFG`的第0位来使 RTS 生效
    2. 用1个前导码字节填充 U2H FIFO、然后填充1到31个随机模式字节
    3. 在每个字节被写入 U2H FIFO 后、重复以下50次:将递增值写入一个不相关的寄存器(`DAC_OFFSET`)并读回该值  
    4. 允许 HART 数据传输的延迟:(833us)*(每个 HART 字符11位)*(HART 字符数)
    5. 通过清除`Modem_CFG`的位0、使 RTS 无效
    6. 清空 H2U FIFO 并确认所有非前导码字节都已接收、没有额外的字节

    请注意、上述步骤仍然相似、但与 HART FIFO 操作交错的寄存器写入不相关。  

    `DAC_OFFSET`写入在上述循环的每几百次迭代中失败一次、并且始终是  写入`FIFO_U2H_WR`后的第一次写入`DAC_OFFSET`。 回读操作检测到写入故障、该操作会报告上一个非递增的值。  

    在 `的波形中、IRQ 引脚启用为低电平有效、唯一未屏蔽的调制解调器 IRQ 是` FIFO_U2H_EMPTY_FLAG。

    观察到的相关性是、当`FIFO_U2H_EMPTY_FLAG`取消置位时、在非常接近 SPI CS 取消置位的时间时、将忽略 SPI 写入。  

    该计时相关性是唯一的写入失败。 在成功写入的情况下 、观察到`FIFO_U2H_EMPTY_FLAG` IRQ 在 SPI CS 取消置位之前或之后取消置位、但绝不像上述故障那样接近。 以下是一些使用 close 但明显不同的成功写入示例、"CS-deassart 与 FIFO_U2H_empty_flag-Dessart"时序。

    您对 U2H FIFO 状态和 SPI 写入之间的这种相关性有什么想法吗?  

    对未决问题的答复

    我们的实现方案遵循第6.6节中的 SPI 时序要求以及图6-1中的图表。

    通过类比 Discovery 2和 Waveforms 软件来记录数字数据。 探针连接到 AFE881H1EVM 的 J9。  

    我验证了 后续输出帧中的错误 CRC 设置`CRC_ERR`位、如"图7-29所示。 SPI 帧详细信息(默认、启用 CRC)"。 在我们的故障模式下会观察到良好的 CRC。  

    如上所示、CS 在 SPI 传输结束之前不会被释放。

    下面是 SPI 帧的模拟捕获。 我没有看到电压或时序问题。  

    • 通道4:MISO
    • 通道3:MOSI
    • 通道2:SCLK
    • 通道1:CS

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Steven、

    我会给你回电话。 我需要由数字设计工程师进行讲解、看看他是否有任何想法。

    约瑟夫·吴

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    Asha 和 Steven、

    我已经和数字设计师谈过、但仅简单介绍一下。 他对这个问题没有任何想法,但正在研究它。

    可以清楚地看到、SCLK 仍然是1MHz、对吗? 他确实明确地提出了这一问题。

    约瑟夫·吴  

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    Asha 和 Steven、

    我仍在与数字设计人员合作。 我想他已经了解问题所在。 我很快就会给您解释、并就该测试进行一些相关的工作。

    约瑟夫·吴

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Asha 和 Steven、

    我们有机会研究一下这个问题、我们发现了这个问题。 当器件从 U2H_FIFO 写入 HART FSK 时、SPI 通信中会发生写入问题。 我将解释该机制、以及如何解决它。

    当器件传输 HART FSK 时、器件从 FIFO 中提取数据。 对于在大约9.2ms (总共11位时间)的周期内发射的每个字节、都会发生数据提取。 对于每次数据提取、有一个内部复位脉冲(~1us)、此脉冲清除了来自 FIFO 的读取请求。 遗憾的是、如果这个清除与一个 SPI 写入同时、那么它也会清除 SPI 传输。 我们已在 Verilog 代码中检查了这一点、并通过模拟器件的数字部分验证了这种机制。

    在本例中、当您首先填充 FIFO 然后设置 RTS 时不会看到这一点、因为您已经写入了 SPI。 U2H_FIFO 提取永远不会与 SPI 写入同时发生。 如果您首先设置 RTS、然后填充 FIFO、则器件开始发送 HART、并且在某些情况下、SPI 写入与 U2H_FIFO 获取同时发生并清除该 SPI 写入。

    由于在 HART 传输期间执行此清除会影响 SPI 通信、因此您只能在器件未从 U2H_FIFO 中提取 HART 数据时发送 SPI 通信。 这意味着、您必须能够对 SPI 通信和 HART 传输进行计时。

    确定这个取指令时间的最佳方法是使用 IRQ。 IRQ 可设置为检查 FIFO 何时为空、满或处于某个用户编程的电平。 在之前的每种情况下、IRQ 都会指示器件何时已完成 HART 字节传输并开始 U2H_FIFO 的提取以传输下一个 HART FSK 数据。 在 IRQ 指示处、器件将发送下一个 HART FSK 字节。 经过9ms (略小于10位时间)后、SPI 应该可以自由接收数据。 您会对 U2H_FIFO 执行该写入操作。

    要写入 FIFO、数据取决于特定序列中的正确写入操作、因此无法重复写入。 对于大多数其他操作、如果您没有写入 FIFO、那么另一种应对此问题的方法是每当器件传输 HART 时写入 SPI 数据两次。

    如果您有任何问题、请告诉我。

    约瑟夫·吴

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    作者:Joseph、

    感谢您的解释和您在确定根本原因方面所做的工作。 借助相同测试环境中的固件权变措施、到目前为止、已通过超过30,000条 HART 消息并显示0字节错误。

    是否有其他事件会导致与 U2H_FIFO 提取类似的内部复位脉冲?  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Steven、

    我很高兴您的帮助、并感谢您让我知道这一点。 如果您有任何其他问题、可以发布新帖子。

    约瑟夫·吴

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Asha 和 Steven、

    在撰写 AFE882H1 (具有非常类似的数字部分)的同时有另一篇 E2E 文章与您的问题。  因为那篇文章有写 HART 的问题,我提到了这个主题,只是为了防止海报遇到同样的问题。

    今天、 我曾询问过一位数字设计人员有关该问题的问题、并获得了有关该问题的确切计时的更多详细信息。 我写了一篇更详细的文章的时间问题,我认为你可能有兴趣阅读。 无论如何、都可以在以下链接中找到该帖子:

    https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1323456/afe882h1-fifo_u2h_wr

    约瑟夫·吴