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[参考译文] THS1206:THS1206差分通道上的输出值相同

Guru**** 1105770 points
Other Parts Discussed in Thread: THS1206
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1343695/ths1206-same-output-value-on-both-the-differential-channels-of-ths1206

器件型号:THS1206

您好!

我正在开发连接到 FPGA (XC7A75TFGG676-2L)的 THS1206 ADC。 2个控制寄存器编程为:CNTR0 = 0x0C8和 CNTR1 = 0x410。 当我从 ADC 读取两个通道的数据输出时是相同的。 2个输入的连接方式为:具有3kHz 1.2Vpp 的差分正弦波的 AINP-AINM 和 BINP-BINM  短接、即0V。 我尝试了使这两个差分输入保持开路状态、然后两个输出也看起来相同。

我将添加屏幕截图以作为参考、这时通道 A 为差分输入、通道 B 短路。 CONV_CLK 为6 MHz。 DATA_AV 正在进行切换、但不是周期性的。 您能否告诉我、为什么两个差动通道得到相同的输出值? 为什么 DATA_AV 不会定期切换?

谢谢

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    尊敬的 Prakash:

    假设您遵循图34的流程图(您需要0x401、0x400序列)、您针对控制寄存器的值看起来没有问题。  想知道您的屏幕捕获中包含了什么_ADC_Curr 和_ADC_nxt。  从_data_out -似乎什么都没有变化太大。  如果 AINx 上有一个满量程正弦、我应该会看到0x800和0x7FF 之间的值。  由于 THS1206是流水线转换器、因此您需要等待后再执行初始读取。  请查看图26并注意 DATA_AV 和 td (Pipe)信号。 如果违反 td (Pipe)延迟、则会 对 DATA_AV 输出的反应方式产生影响。  在您发送的截屏中、它在我看来是周期性的、那么、如果以比您显示的时间范围更宽的时间范围进行更改呢?

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    您好、Tom、

    感谢您的答复。

    由于我将使用状态转换、因此这些信号用于电流和下一状态。

    我负责图34的流程图以及初始阅读。 在捕获的屏幕截图中、DAT_AV 信号看起来是周期性的、因为它已经过缩放。 但它在广泛的周期内不是周期性的。

    我仍然不明白为什么两个通道输出相同? 我漏掉了什么吗?

    此致

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    您能否共享原理图?