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[参考译文] ADS1278:SPI 配置

Guru**** 2382630 points
Other Parts Discussed in Thread: ADS1278
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1355071/ads1278-spi-configuration

器件型号:ADS1278

大家好,

   我在数据采集系统项目中工作、因此我们需要8通道输入在此情况下、我们选择 ADS1278。 要通过 SPI 协议配置 ADS1278、

我们 通过 I/O 引脚配置  

ADS1278 输入引脚 - 测试 PIN[0:1] //该引脚设置为  低电平  因为我们使用  正常模式

ADS1278输入引脚- 格式 PIN[0:2]  //此引脚设置为低电平 ,因为我们使用了 SPI TDM 动态格式。

ADS1278输入引脚- 模式 PIN[0:1] //该引脚设置为 低电平 ,因为我们使用了高速模式

ADS1278输入引脚- POWER DOWN PIN[0:8] //该引脚设置为 高电平 ,因为我们使用了 8通道输入

ADS1278输入引脚- CLKDIV 引脚1 //此引脚设置为 高电平 ,因为我们需要更高的每秒采样数

ADS1278输入引脚片选/SYNC 引脚1 //该引脚被设置为 高电平或低电平(基于条件)。

ADS1278输出引脚- DRDY  引脚1 //读取引脚。

FCLK = 25MHz

SCLK = 25MHz

在完成配置后、  

第一  芯片选择/同步 引脚置于低电平

在监测 DRDY 引脚//当引脚为 L 时 移动下一个条件。

在 SPI 中、写入24字节、DATA=0将发送/也发送24字节的 SCLK 也会发送。

但是、借助 SPI 读取功能、  

芯片选择/同步 引脚放置 ...... 此时 DRDY 引脚设置为

如何检索数据...?

请给我一个参考代码。

谢谢。此致、

Aravind. SR

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Aravind:

    除了使用/SYNC 引脚之外、设置看起来是正确的。  SYNC 功能类似于复位;当为低电平时、器件处于复位状态、不会进行任何转换。  当 SYNC 置于高电平时、在第一个转换数据就绪之前将有一个延迟、由/DRDY 的下降沿指示。  数据表中的图73显示了/SYNC 和/DRDY 的行为。  /SYNC 上升沿之后第一个转换结果之前的延迟时间是 tNDR、等于129个转换周期。  在您的情况下,由于 CLK=CLK 25MHz (我假设您有一个25MHz 连续时钟连接到25MHz 引脚27),因此转换周期将是1/CLK*256=10.24us。  tNDR=129*10.24=1.32毫秒。

    在/SYNC 引脚置于高电平并满足 tNDR 时间后、/DRDY 引脚将以输出数据速率进行脉冲。  在您的配置中、这将是97.656ksps。  您的处理器需要轮询/DRDY 引脚或使用中断进行监控、并查看/DRDY 下降沿。  此时、您可以使用器件外部的 SCLK 为数据计时。

    如果在/DRDY 引脚上没有看到任何活动、则表示存在硬件问题。  我建议检查所有电源电压、并验证 CLK 引脚上是否存在连续25MHz 时钟。  该时钟的电压电平应等于 IOVDD 电源电压。

    此致、
    N·基思
    精密 ADC 应用