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[参考译文] ADC3663:在数据引脚和时钟引脚中将 SLVDS 更改为 LVDS

Guru**** 2382630 points
Other Parts Discussed in Thread: ADC3663, SN65LVDS100
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1482626/adc3663-slvds-to-lvds-in-data-pin-and-clock-pin

器件型号:ADC3663
主题中讨论的其他器件: SN65LVDS100

工具与软件:

大家好、团队成员:

客户正在使用连接 Xilinx 7035的 ADC3663进行测试。

他们正在考虑 ADC3663数据表和 FPGA 数据表之间有关 SLVDS 和 LVDS 的不同电压标准

我看到了一些关于信号标准的 E2E 问题、但我不确定我们是否需要转换器、或者我们是否可以直接连接 ADC3663和 FPGA。

  • DCLKIN 使用

FPGA 可以输出具有1至1.425V VCM (典型值为1.2V)和247至600mV (典型值为350mV)的信号 VOD 至 ADC3663

ADC3663输入规格为1-1.3V (典型值为1.2V)和200至650mVpp (典型值为350mVpp) VOD

  • 数据通道

ADC3663可在500至850mVpp VOD 范围内输出1.0Vcm。

FPGA 可以接收0.3-1.425V、典型值为1.2V、VOD 范围为100mV 至600mV

我的问题是:

如何理解 ADC3663中的输入 Vcm 和 VOD、这是否意味着我们可以接受1到1.3V 之间的任何 VCM 电压、并接受200到650mV 之间的 VOD 电压、ADC3663如何识别高电平和低电平信号?

ADC3663能否直接连接 FPGA? 或者我们需要一些交流耦合+偏置方法或转换器?

谢谢!

Yishan Chen

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    再添加几个问题:

    1.数据表中的 mVpp 是指 VOD 中的峰峰值? 例如、700mV 表示 DA 引脚中的1+0.35V 和1-0.35V?

    我们的 DCLKIN 中是否有100ohom 端子电阻器或 Bias?

    ADC3663 DCLK 引脚能否承受1.425+0.6V 和1.425-0.6V VCM 和 VOD?

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    尊敬的 Chen:

    ADC3663可通过任何 LVDS IO 组直接连接到 FPGA。 请确保启用了100欧姆差分终端。

    对于 DCLKIN、您需要提供共模偏置来驱动这些输入。 简单的 SN65LVDS100 LVDS 转换器、驱动器就能做到。

    此致、

    Rob

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    尊敬的 Rob:

    感谢您的评分

    顺便说一下、您能不能帮我理解我上面提出的问题?

    谢谢!

    Yishan Chen

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    尊敬的 Yishan:

    你有很多问题。。 请具体告诉我您的问题。

    此致、

    Rob

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    请查看以下问题:

    1.数据表中的 mVpp 是指 VOD 中的峰峰值? 例如、700mV 表示 DA 引脚中的1+0.35V 和1-0.35V?

    我们的 DCLKIN 中是否有100ohom 端子电阻器或 Bias?

    ADC3663 DCLK 引脚能否承受1.425+0.6V 和1.425-0.6V VCM 和 VOD?

    4、为什么数据通道可以直接连接但 DCLK 需要偏置?

    谢谢!

    Yishan Chen

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    尊敬的 Yishan:

    1:是的、正确

    2、不需要100欧姆、不需要 DCLKIN 偏置、请参阅 EVM 原理图作为指南

    3:DCLKIN 需要偏置、DCLK 会连接到 FPGA、连接方式与数据通道相同

    谢谢!

    Rob