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[参考译文] DS90UB953-Q1:延迟计数

Guru**** 2394305 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1514201/ds90ub953-q1-latency-counting

器件型号:DS90UB953-Q1

工具/软件:

 尊敬的 TI 团队  

我刚刚看到评论"954、延迟由954中的行缓冲区决定。 与954线路缓冲器时间相比、953串行化产生的其他延迟和通过电缆的传播延迟较小。  

954可缓冲来自每个 RX 端口的最多2条线路、因此延迟大致等于线路时间的2倍。  

示例 对于1280x800 @ 60Hz、视频线时间为~20.1us:

因此、总缓冲时间将~40.2us、这大约等于通过953/954链的总延迟。 "

我想确认、当整个图像发送完毕后、应该需要 800/2倍于40.2us = 400*40.2us= 16080us= 1.6ms  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好:Yu-Chang、

    所示表格是特定视频流的水平时序示例。 具有不同分辨率的不同视频流将具有不同的行周期。

    在该示例中、最坏情况下的延迟是每条线路都在缓冲区中保持 x2个线路周期。 这意味着在本例中、整个帧间在最坏情况下的延迟将为800 x  40.2us = 32ms

    但是、不太可能达到这一点、因为我们的 DES 器件会持续将视频数据线从 RX 端口线路缓冲器拉至输出端。 整个帧的理想延迟为 800 x 20.1us = 16ms、其中每行视频数据在到达时立即从 RX 端口拉出。

    此致、

    Justin Phan