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[参考译文] DS90UB928Q-Q1:引脚设置

Guru**** 2377000 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1515118/ds90ub928q-q1-pin-settings

器件型号:DS90UB928Q-Q1

工具/软件:

尊敬的专家:

我的客户对以下引脚设置有疑问、他们不熟悉 FPD-link、您能支持该问题吗?

#1 未使用引脚设置  

它们不使用下面的引脚。 这些引脚是否可以悬空? 或所需的任何其他端接?

#2 当 IDX=L 时、是否可以直接连接 GND?

#3 内部下拉电阻

您能告诉我“具有内部下拉电阻的 I/O LVCMOS“引脚的内部电阻吗? 近似值正常。

此致、

Youhei MIYAOKA

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    你好 Youhei、

    #1 未使用引脚设置

    当所有这些引脚配置为输入时、都具有内部下拉电阻器。  但是、这些引脚默认设置为输出、因此 PD 更安全。

    #2 当 IDX=L 时、是否可以直接连接 GND?

    建议通过 PD 电阻接地、以防止漏电流。

    #3 内部下拉电阻

    内部 PD 电阻器约为 25K Ω

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    尊敬的 Hamzeh:

    我可以再次确认 MCLK 引脚吗? 此引脚不与任何其他引脚共享。 该引脚是否也有内部下拉电阻器?

    此致、

    Youhei

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    你好 Youhei、

    你是对的。 该引脚没有内部下拉电阻、因此如果悬空、则需要外部下拉电阻。 10kohmresistor 就可以了。

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    尊敬的 Hamzeh:

    谢谢! 我收到了有关 LOCK 引脚的其他问题。

    当发生异常时、当 LOCK 引脚的操作变为低电平时、发生以下哪个过程?

    -继续低电平、直到故障清除
    -经过一段时间后,它变为高电平,如果它不被释放,它再次变为低电平
    在后一种情况下、请告诉我们低电平的持续时间。

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    嗨、Youhei、

    如果链路出现任何问题、LOCK 引脚将变为低电平并保持低电平、直到故障清除、然后它将变为高电平。