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[参考译文] DP83822I:需要电源序列支持

Guru**** 2381800 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1534504/dp83822i-power-sequence-support-needed

器件型号:DP83822I

工具/软件:

您好的团队、

在客户的 持续设计中、 通过为 AVD 供电的 3.3V 电压产生了 2.5V 的 VDDIO 电压。

因此、在 VDDIO 完全斜升之前、不可能等待 AVD 斜升。

因此、我的客户想知道当 VDDIO<VDDIO+0.3V 时是否允许使用 AVD。

请检查一下。

如果不建议这样做、请告知如何解决?

此致、

伊藤和树

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    尊敬的伊藤山:  

    因此、我的客户想知道 VDDIO 时是否允许这样做 我认为不建议这样做、因为可能会发生误检。  当 AVD 完成斜升并在 该电源轨仍在斜升时对 VDDIO 电压进行采样时、会发生错误检测。 在这种情况下、PHY 可能会 在电源轨完成斜升之前错误地读取 VDDIO 电压。


    作为权变措施、客户是否可以为 VDDIO 使用 3.3V 电压? 如果不能这样做、我建议同时升高 VDDIO 和 AVD(如果可以这样做)。  

    请告诉我您的想法。  

    此致、
    j


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    尊敬的 J:

    谢谢。 由于客户将 2.5V 用于 MAC 接口、因此 VDDIO 设置为 2.5V。

    他们决定同时斜升 VDDIO 和 AVD。

    此致、

    伊藤和树

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    尊敬的伊藤山:

    很高兴听到! 如果客户有其他问题、请告知我。

    此致、

    j

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    尊敬的 J:

    我有客户的几个问题。

    1. 如何确定 T1:±100ms? 该 测量值是否为每个电压轨的 50%?
    2. 如果是、看起来允许同时斜升、因为它在±100ms T1 范围内。
      考虑到这一点、在客户的设计中、AVD (3.3V) 在 VDDIO (2.5V) 之前斜升。
      还可以吗? 您能回顾一下下面的波形吗?
    3. 您能告诉我 分别是 VDDIO=2.5V 和 AVD =3.3V 的电流和功耗吗?
      在表 10-1 中未找到此组合。

    此致、

    伊藤和树

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    尊敬的伊藤山:  

    1.正确。  
    2.波形除了有一个 1V 的初始斜坡 2.5V 是良好的。 请确保客户可以遵循  VDDIO<VDDIO+0.3V AVD 并同时斜升(如果可能)。  
    3.我在我们这边找不到这个数据

    请告诉我。  

    此致、

    j

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    尊敬的 J:

    关于#2、 是的、初始有 1V 斜坡、但仍在 数据表中指定的 t1=±100ms 范围内。  不允许吗?

    关于#3、我的客户正在转至 Table 10-1 Power Supply Characteristics(表 10-1 电源特性)。 但是、我的客户想在  VDDIO=2.5V 和 AVD =3.3V 下提供数据。 有道理吗?

    此致、

    Kazuki Ioth

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    尊敬的伊藤山:  

    2.是的,时机还可以。 我在数据表中讨论了这一点:
    在电源斜坡之前、AVD 和 VDDIO 电位不得超过 0.3V。

    尤其是当 AVD 根本没有斜升时、以防止检测错误。  

    3.我知道您需要 2.5V VDDIO 和 3.3V AVD。 不幸的是、我们无法找到数据、因此 必须收集数据。 这很可能需要几周的时间。

    请告诉我。  

    此致、
    j

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    尊敬的 J:

    谢谢你。

    > 不幸的是,我们无法找到数据,它将不得不收集。 这很可能需要几周的时间。

    我的客户 要求我们收集数据。 这是好的 ,即使它需要几个星期。

    您能否提供支持?

    此致、

    伊藤和树

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    尊敬的伊藤山:  

    我们可以支持这一点。 但请注意、美国有 7 月 4 日假期、因此美国办事处将关闭。  
    假期结束后、我们预计收集数据需要两周时间、因为实验室中目前未设置功耗。  

    我会随时更新您的最新信息。  

    此致、
    j

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    尊敬的 J:

    感谢您对此采取行动。 我还有一个问题。

    即使 DP83822 的 RESET_N 引脚通过外部下拉电阻变为低电平并且 RESET_N 在 VDDIO 和 AVD 完全斜升后变为高电平、也是否应严格遵循电源序列?
    我的客户猜测、除非 RESET_N 引脚变为高电平、否则包括硬搭接在内的 IO 引脚不会运行、因此可以避免误检测。

    此致、

    伊藤和树

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    尊敬的伊藤山:  

    我们建议即使在 RESET_N 引脚为低电平时也应遵循电源序列 、因为考虑到复位信号 将为 低电平、给出了建议。 但是、客户的理解是正确的、即在 RESET_N 变为高电平之前、Strap 配置不会采样。  

    此致、
    j

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    尊敬的 J:

    这对我来说仍然没有意义。

      当 RESET_N 为低电平时、为何建议遵循电源序列、而 在 RESET_N 变为高电平之前、Strap 配置不会采样?

    您能说明一下吗?

    此致、

    伊藤和树

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    尊敬的伊藤山:  

    我们建议在 RESET_N 为低电平时遵循电源序列、以确保当启动电源时、PHY 不会初始化并保持在复位状态、因此它不会采样配置 (strap) 或 VDDIO 错误。  

    此致、
    j

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    尊敬的伊藤山:  

    以下是 VDDIO 2.5V 和 AVD 3.3V 的功率测量结果。  
    如果您对此有任何疑问、敬请告知。  
    e2e.ti.com/.../DP83822_5F00_Power_5F00_Measurement.xlsx
    此致、
    j