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[参考译文] TXE8124-Q1:TXE81xx

Guru**** 2587345 points
Other Parts Discussed in Thread: TXE8124-Q1

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1540903/txe8124-q1-txe81xx

器件型号:TXE8124-Q1
主题中讨论的其他器件:TXE8124

工具/软件:

您好、  

有关 TXE8124 锁存输出的问题。  

1.如何理解这句话“具有最大高电流驱动的锁存输出
能够直接驱动 LED“

2. 请参见下图,TXE8124 由常开 3.3V 电源轨供电,RESET 由常开 3.3V 至 10K 上拉。

MCU SPI 信号连接到 TXE8124、并将 P0.0 控制为高电平。

我的问题:如果 MCU 断电,但 TXE8124 仍通电,没有重置,  P0.0 能保持高水平吗?

谢谢!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Bin:

    1. 如何理解这句“具有最大高电流驱动能力的锁存输出“
    能够直接驱动 LED“

    配置为在 TXE8124-Q1 上输出的 GPIO 保持其逻辑高电平或低电平输出、具有 mA 电流能力 — 足以驱动 LED。 此输出是推挽式的、因此它会根据输出引脚的配置方式强力驱动高电平或低电平。 这就是我们所说的“锁存“。 输出并非弱驱动、以至于受到与其输出连接的另一个器件的外部影响。  

    我的问题:如果 MCU 已断电,但 TXE8124 仍处于通电状态且没有重置,  P0.0 能否保持高水平?

    这是对的。 只要 TXE8124 已配置为抢先输出、其 I/O 将保持已配置的输出逻辑状态、前提是 TXE8124-Q1 已在 VCC 上电且/RESET 被拉至高电平。  

    此致、

    Tyler