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[参考译文] DS90C031QML-SP:DS90C031QML 输入级的设计注意事项

Guru**** 2551110 points
Other Parts Discussed in Thread: DS90C031QML

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1570161/ds90c031qml-sp-design-considerations-for-ds90c031qml-input-stage

器件型号:DS90C031QML-SP
主题中讨论的其他器件:DS90C031QML

工具/软件:

你(们)好  

我们 在设计中使用 DS90C031QML。 芯片组由 5V 电源供电。 出于辐射能力和器件供货情况的原因、我们有限责任使用此芯片组。  

主要问题是我们的 MCU 由 3.3V 电源供电、其数字输出限制在 3.3V 域。

查看 DS90C031QML 数据表、可以看到 VIL 和 VIH 的逻辑电平分别为 0.8 和 2V。 MCU 的 CMOS 功能可以实现这一点。  

但可以看到、 DS90C031QML 数据表还在线路驱动器的输入端指定了失效防护电路。 这会在 MCU 和线路驱动器的 5V 电源之间产生馈电风险。  

我想知道如何对该输入失效防护偏置电路进行建模、以便使用分立式元件设计电平转换器。 我能否在输入端使用 500K 上拉电阻(数据表中的 5V 除以 10uA 输入电流规格)对其进行建模?还是另一个模型更好?  

在这种情况下、是否有必要设计一个电平转换器?  

非常感谢、祝大家愉快。

Pierre

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    您好、Pierre:

    为了确保我正确理解您的问题、您指的是输出 tri 状态模式、在该模式下、DOUT 差分引脚在输出被禁用时变为高阻抗、或者您是否想了解单端输入引脚阻抗(DIN 引脚)?  

    此致、

    马特  

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    您好、Matt。 非常感谢您的快速答复。 我指的是单端输入引脚阻抗。 失效防护偏置电路是否位于输入引脚电平;如果是、它如何影响输入引脚阻抗? 它能否在我们的 3.3V(驱动驱动器输入引脚的 IO)和 5V(驱动器电源)之间产生电源馈电?  

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    您好、Pierre:

    失效防护电路仅适用于器件的输出引脚 (DOUT)。 在您所描述的场景中、您所指的输入引脚 (DIN) 不会受到风险。 只需确保不超过引脚的绝对最大限值(–0.3V 至 Vcc+0.3V)。 如果您想对输入电流消耗进行建模、则只需在该引脚上使用一个 500k Ω 下拉电阻器。

    此致、

    马特