器件型号: DP83867E
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您能否告知在实现寄存器更改时是否需要在链路长度方面进行权衡?
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该寄存器的变化是否会降低 PHY/的灵敏度?影响是什么?
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我们是否可以将这些寄存器设置为任何其他中间值、以便 在抗扰度性能和链路长度之间实现某种平衡?
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我们能否仅实现必要的寄存器更改(其中一些更改)? 那么我们仍然通过了合规性测试并实现了目标长度呢?

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器件型号: DP83867E

您好、
当链路速度在 100M 下降到 10Mbps 时、如果未实现、它可以正常运行 (100M 时为 1000Mbps)、在本例中、谁是链路伙伴、是另一个 DP83867 吗? 这种情况是否存在或不存在行为抗扰性?
如果您禁用 10M 广播、您是否能够通过变通办法以 1000M 的速度建立链路?
寄存器 0x00C0 和 0x00B3 配置 DP83867 RX、而 0x0100 配置 DP83867 DSP。 如果您不更改寄存器 0x00c0 和 0x00B3、您能否通过抗扰度测试并在 1000M 处建立链路?
谢谢
David
谢谢 David、
链路伙伴是 HP 1820-8G 交换机 J9979A、不知道它使用的是什么 PHY。 这是没有运行的传导抗扰度。
我们已尝试在 100M 单独启用强制协商和自动协商。 当强制以 10Mbps 运行时可以正常运行。 强制为 100/1000Mbps 时、无法使设备联机。 启用自动协商后、链路速度会降至 10Mbps。
我们将首先执行链路测试、而不实现寄存器 0x00C0 和 0x00B3。 如果通过、接下来将进行传导抗扰度测试。
您能否提供更多有关这些寄存器更改在 DP83867 RX 配置和 DSP 中实际执行的操作的信息? 我们想进一步了解这些影响。
非常感谢
Kesh
您好、
得到寄存器值。 启用自动协商时尝试突出显示差异。 希望这有所帮助。
我们还测试了两个不同的单元。 在不更改寄存器的情况下运行寄存器 0x12 和 0x14 时、具有不同的值。
您好、
感谢寄存器转储、在查看转储时、我确实看到在单元 1 上没有或有寄存器权变措施时链路已接通 (0x01 = 0x796D)、而在单元 2 上没有寄存器权变措施。

当链路与单元 2 上的寄存器权变措施接通时、我看到正在将值 0x003E 写入寄存器 0x16、从而将 PHY 置于环回模式

这是有目的的吗? 如果您没有将 PHY 置于环回模式、能否建立链路?
谢谢
David
您好、
DP83867 没有用于启用/禁用环回模式的硬件搭接。 MII 环回仅使用 BMCR(寄存器地址 0x0000)进行配置。 所有其他环回模式仅通过使用 BISCR(寄存器地址 0x16)启用。 您还可以读取寄存器 0x006E 和 0x006F、以仔细检查每次下电上电之间的 Strap 配置状态。
您是否发现第 2 单元或多个单元之间存在这种不一致? 如果只在一个器件上、是否可以进行 ABA 交换、看看一致性是在器件还是电路板之后? 如果不是、是否可以探测 DP83867 MDIO 和 MDC 引脚、确保实际上不会写入 DP83867 寄存器?
谢谢
David
谢谢 David、
请告知这是否是禁用环回的正确方法?
尊敬的 Keshav:
从同一个团队中加入 David。 在看你最新的垃圾场时,我有一些困惑。
查看“Auto"部分“部分、我看到寄存器 0x9 读回为 0x4806。 这表示 PHY 处于[15:13]范围内的测试模式。 但是、在 2m 的情况下设置了这个相同的值。 我怀疑 SMI 可能存在一些问题、因为 PHY 在发送测试模式时应该无法获取链路。 在用 100 欧姆差分端接和差分探头筛选出该线路时、可以明显看出这一点、在这里可以观察到正弦波形(根据 SNLA246 文档为 TM2)。
由于寄存器访问对于准确检查 PHY 运行状况至关重要、因此在进一步说明之前、我想先集中精力清除这方面的内容。
此致、
Gerome
您好、Gerome、
我探测了端接电阻为 100 Ω 的差分对。 此时没有得到任何正弦波形。 相反、我收到的是自动协商链路脉冲、它确认 PHY 未在 TM2 中并尝试连接。 这与寄存器 0x9 读取值不匹配。
我还使用逻辑分析仪探测了 MDC 和 MDIO(它是在不同的单元上完成的,但固件相同)。 我看不到启动后发生任何写入。 但有几个未知的事件正在发生。 加电后的第一次读取是 寄存器地址 0x00 上的 4400、表示环回+隔离。 附件是以表格形式显示的解码消息和屏幕截图。
谢谢
e2e.ti.com/.../Start-up-MDIO-decode.csv
