[参考译文] DP83867IR：DP83867 配置和硬搭接问题

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

器件型号： DP83867IR

我们观察到了一个与 RX_CTRL 硬自举引脚相关的问题（使用外部 5.76k Ω 上拉电阻器和 2.49k Ω 下拉电阻器作为分压器进行配置）。此问题未完全发生、某些电路板也未出现此问题。

在受影响的电路板上、IC 进入故障状态并且无法正常运行。即使我们将复位信号置为有效、RX_CTRL 引脚上的分压电压仍然不正确。

恢复设备的唯一方法是执行以下步骤：

移除 RX_CTRL 引脚上的外部上拉和下拉电阻器。

在电阻（欧姆）模式下使用万用表测量 RX_CTRL 引脚对地。测得的电阻最初读数为几 k 欧姆、然后逐渐增加、最终上升到大约 50–60 k 欧姆。

重新安装上拉和下拉电阻器。此后、IC 恢复正常运行。

这种行为表明、万用表的电阻测量值（施加小电压或电流）可清除 IC 内部的内部故障条件。

我们还观察到、即使在问题得到解决后、如果电路板长时间未使用、也可能会再次发生故障。

您是否有任何可以帮助我们解决此问题的见解或建议？

0 admin 3 个月前

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您好：

是否在带电电路上进行阻抗测量？我不推荐这种方法。

大多数 Strap 配置问题源于时序不佳以及会影响电阻器设置的偏置点的外部电路。为了排除这一假设、我想建议进行以下实验：

-通过串联电阻器去 POP 和切割布线连接 PHY 和 SoC。

-打开 PHY 并通过引脚保持复位状态。在这种状态下测量引脚处的电压。

-测量在几个板和电源循环,以排除难以捉摸的行为。

此致、

Gerome

0 admin 3 个月前

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您好、Gerome、

感谢您的答复。

所有电阻测量都是在电路板断电时执行的。
我们观察到、测得的阻抗最初看起来是几千欧、然后随着时间的推移逐渐增加、最终达到大约 50–60 千欧。这种行为对我们来说似乎很不寻常、它让我们怀疑测量本身可能正在清除或复位 FPGA 或 PHY 中的内部条件。

接下来、我将介绍 VDD、XI、RESET_N、MDC 和 RX_CTRL 的时序。
我还将尝试使 ETH 复位信号保持置为有效、直到 FPGA 硬件 I/O 配置完成、然后使其失效、以查看此操作是否解决了问题。

此致、
David

0 admin 3 个月前

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您好、David：

非常奇怪的是、会发生一些断电锁存行为。所有器件都发生了这种情况吗？我知道它是零星的、但我对样品的大小很好奇。期待您的图表。

注意：我到了一周的末尾。

此致、

Gerome

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