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[参考译文] DP83848I:关于 SNI 模式的行为。

Guru**** 3001220 points

Other Parts Discussed in Thread: DP83848I

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1645330/dp83848i-about-the-behavior-of-sni-mode

器件型号: DP83848I

您好的团队、

‑在 SNI 模式(10BASE‑T、半 μ s 双工)下使用 DP83848I、并有两个有关 COL、CRS 和 RX_CLK 行为的相关问题。
确认器件处于 SNI 模式 (10MHz 处的 TX_CLK 和 RX_CLK 、10BT_SCR[15]=1)。
 
问题 1:COL 置位没有明显的 TX/RX 冲突
我们的理解是、COL 会在发生冲突时(即发送和接收重叠时)置位。
但是、我们会观察到以下情况:
  • COL 置位
  • 有效 TX 数据和 RX 数据在 MAC 接口上没有明显的重叠
  • 链路伙伴是标准交换机
  • 操作为半‑μ H 双工
  • 不会有意引入后期冲突
问题:
  1. 在 DP83848I 的 SNI‑下、即使没有明显的 MAC 级别 TX/RX 数据冲突、COL 是否也能生效?
  2. ‑RXD_0 未向 MAC 提供有效数据、COL 是否完全基于发送期间的 PHY 级别载波检测(例如,TX 期间 CRS 处于活动状态)置位?
  3. 尽管 MAC 没有看到“逻辑“冲突、但 COL 是否会断言‑SNI 的特定条件?
问题 2:CRS 在 SNI 模式下停止时为高电平
‑还观察到以下接收 μ P 侧行为:
  • CRS 变为高电平(检测到载波)
  • COL 保持低电平(无冲突)
  • CRS 变为高电平后、RX_CLK 停止切换
  • 当 RX_CLK 停止时、RXD_0 不会继续更新
我们的理解是:
  • CRS 指示有效的接收数据
  • RX_CLK 是 SNI 接收时钟
  • 因此、当 CRS 为高电平时、RX_CLK 将继续切换
但是、观察到的波形与此假设相矛盾。
问题:
  1. 在 SNI 模式下、只要 CRS 为高电平、是否可以保证 RX_CLK 持续切换?
  2. 或者、如果 RXD_0 数据显示为 MAC、即使 CRS 保持高电平、RX_CLK 也仅在期间有效吗?
  3. 即使在 RX_CLK 停止且未输出 RXD_0 数据的情况下、CRS 也可以由于载波/能量检测而置为有效吗?

此致、
Ryu。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Ryu、

    我将查看此问题、并尽快回复您。

    此致、

    GREG

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    您好 Gregory、

    感谢您的答复。
    我期待收到您的答复。

    此外、关于冲突期间 SNI 模式下的行为、请告知。
    发生冲突后(COL 置位后)、在发送/接收过程中、以下信号是否会持续输出?
    ・TX_CLK・RX_CLK・CRS・TD±・RXD[0]

    此致、
    Ryu。

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    您好、Ryu、

    • 在启用检测信号的 10BASE-T 半双工模式下、COL 引脚在发送结束时也会在大约 1µs 的持续时间内置位、以便指示检测信号。 是否在您的设置中启用了心跳?
    • 是的、 COL‑基于传输期间的 PHY 级载波检测进行置位

    对于附加问题、是的。COL 应在置位后持续输出这些信号。

    此致、

    GREG

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    您好 Gregory、

    感谢您的答复。
    我将研究心跳问题。
    为了澄清问题、您能回答六个问题中的每一个问题吗?

    [报价 userid=“497502“ url=“~/support/interface-group/interface/f/interface-forum/1645330/dp83848i-about-the-behavior-of-sni-mode
    • 在 DP83848I 的 SNI‑下、即使没有明显的 MAC 级别 TX/RX 数据冲突、COL 是否也能生效?
    • ‑RXD_0 未向 MAC 提供有效数据、COL 是否完全基于发送期间的 PHY 级别载波检测(例如,TX 期间 CRS 处于活动状态)置位?
    • 尽管 MAC 没有看到“逻辑“冲突、但 COL 是否会断言‑SNI 的特定条件?
    [quote userid=“497502“ url=“~/support/interface-group/interface/f/interface-forum/1645330/dp83848i-about-the-behavior-of-sni-mode
    • 在 SNI 模式下、只要 CRS 为高电平、是否可以保证 RX_CLK 持续切换?
    • 或者、如果 RXD_0 数据显示为 MAC、即使 CRS 保持高电平、RX_CLK 也仅在期间有效吗?
    • 即使在 RX_CLK 停止且未输出 RXD_0 数据的情况下、CRS 也可以由于载波/能量检测而置为有效吗?
    [/报价]

    此致、
    Ryu。

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    您好、Ryu、

    • 即使没有可见的 TX/RX 数据冲突、如果启用了检测信号、该命令也会生效。
    • 是的、正确
    • 不应存在任何特定于 SNI 的条件来实现此目的

    • 是的、正确
    • RX_CLK 持续运行作为内部基准。
    • 对于最后一个问题、我将在内部进行检查、然后返回给您。

    此致、

    GREG

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    尊敬的 Greg:

    还请解释以下情况、您提到的仍在调查中。
    如下面的波形所示、RX_CLK 在 CRS 变为高电平后停止。


    我知道 CRS 是一个信号、当 RXD_0 信号指示有效接收数据时、该信号会置为高电平有效。
    由于 RX_CLK 用作 SNI 接收时钟、因此只要有有效的接收数据(即 CRS 为高电平时)、它就不应该继续输出时钟信号?
    *注意:此时没有发生冲突 (COL)。

    此致、
    Ryu。

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    您好、Ryu、

    我将在内部 进行检查、然后返回给您。

    此致、

    GREG

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    您好、Ryu、

    这是频繁发生、还是在器件运行期间仅发生一次? 如果它仅在初始 CRS 断言后发生、则可能是正常操作。 虽然前导码恢复未完成、但 RX_CLK 的行为类似于这样、因为 PHY 尚未确定 输入为有效且可锁定的信号。

    此致、

    GREG

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    尊敬的 Greg:

    感谢您的答复。

    “如果它仅在初始 CRS 断言后发生、则视为正常操作“意味着它不会重复发生、正确吗?
    这种现象不仅会在启动后发生一次、而且会反复出现。

    “直到前导码恢复完成“指的是哪个时间段?
    它是否意味着前导码传输的时间段?
    “前导码恢复完成“是否与“仅在初始 CRS 生效后“相关?
    由于前导码信号附加到每个数据包的开头并在每次传输、不会每次都发生“直到前导码恢复完成“?

    此致、
    Ryu。

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    您好、Ryu、

    很抱歉、Greg 今天就不在办公室了。 当他下周回到星期一时、请等待答复

    此致、

    Shane

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    尊敬的 Greg:

    我预计何时会收到您的回复?
    此致、
    Ryu。
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    您好、Ryu、

    您能否详细说明一下、在器件正常运行期间、RX_CLK 会在每个数据包之后停止吗? 我最初认为可以在 PHY 等待足够的转换以进行观察时停止此操作。 但是、可能会因这种情况而停止 RX_CLK 太长时间。 时钟在示波器屏幕截图中没有输出多长时间?

    此致、

    GREG

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    尊敬的 Greg:

    出现频率不规则。
    我们观察了启用 CRS 时的时序、但有发生问题的情况和未启用 CRS 的情况。
    此外、发生时、CLK 无效的持续时间也会发生变化;在观察结果中、最多约为 640ns。
    对于较短的情况、大约为 200ns。
    此致、
    Ryu。
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    您好、Ryu、

    我看、这是不正常的行为。 您能否分享该器件的原理图?

    此致、

    GREG

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    尊敬的 Greg:

    请接受我朋友的申请、以便我可以分享原理图。
    我将通过私人信息发送。
    此致、
    Ryu。
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    您好、Ryu、

    我刚刚接受了您的朋友请求。

    此致、

    GREG

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    尊敬的 Greg:

    感谢您的批准。
    我昨天通过私人消息发送了原理图。
    请回顾一下。
    此致、
    Ryu。
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    您好、Ryu、

    我会尽快审核并回复您。 谢谢!

    此致、

    GREG

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    尊敬的 Greg:

    您能否回复私人消息?
    此致、
    Ryu。
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    您好、Ryu、

    我只是在私人信息中提供了一个答案。

    此致、

    GREG

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    尊敬的 Greg:
    感谢您的答复。
    我也在一封私人邮件中发送了此邮件、但我也在这里重新发送它。
    由于原理图无法更改、如果您能指出任何似乎有明确原因的方面、我将不胜感激。
    我还要确认以下几点。
    请您就这些问题提出建议。
    目前观察到、RX_CLK 是否仅在 CRS 启动后立即发生、CRS 结束后立即发生?
    请保证 RX_CLK 在数据接收期间不会被中断。
    与 DP83848I 执行 MII 通信时、是否还会发生类似的现象?
    此致、
    Ryu。
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    您好、Ryu、

    我与我的团队进行了检查、当 CRS 上升到高位时、时钟不应下降。 下一步可能会有所帮助、即在此情况下交叉检查链路 LED 的状态。 链路丢弃可能会导致观察到时钟行为、否则这不是正常行为。 在数据接收期间不应中断 RX_CLK。  

    此致、

    GREG

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    尊敬的 Greg:

    感谢您的答复。
    我检查了 LinkLED、它处于常开状态。
    当 CRS 变为高电平和低电平时都会发生这种情况。
    您是否可以在 EVM 上进行检查?
    蓝色:链路 LED
    绿色:CRS
    黄色:rx_CLK
    此致、
    Ryu。
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    您好、Ryu、

    感谢您分享示波器屏幕截图。 这看起来像是异常行为。 我可以在我的 EVM 上测量并共享相同的信号、但我相信它不会暂停时钟信号。 这可能是由于您 探测信号的方式造成的吗?

    此致、

    GREG

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    尊敬的 Greg:

    感谢您的答复。
    能否请您确认作为预防措施使用 EVM?
    此外、测量方法可能会导致哪些问题?
    如果有任何推荐的测量方法或可能的原因、请告知我们。
    此致、
    Ryu。
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    您好、Ryu、

    我将在本周查看 EVM 并提供结果。 当前完成/探测测量的方式是什么?

    此致、

    GREG

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    尊敬的 Greg:

    感谢 您的 答复。
    我 期待 收到 EVM 结果。
    测量 环境 如下所示。
    使用的示波器: MSOX6004A (MSOX6004A | Keysight Technologies 工作台 示波器、 1GHz 、 16 通道 | RS)。
    使用的探头: N2894A (N2894A 无源 探头 、10:1700MHz、 1.3 m | Keysight)。
    GND 连接 方法: CH1 [RX_CLK] 使用 探头随附的接地弹簧。
    CH2 [CRS] 和 CH3 [LINK] 使用 探头随附的接地引线。
    测量 点: CH1 位于 阻尼 电阻 (22Ω)的 PHY 侧。
    CH2 位于 阻尼 电阻器 (22Ω)的 PHY 侧。
    CH3 位于 链路 LED 限流电阻器(330Ω)的 PHY 侧。
    此致、
    Ryu。
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    您好、Ryu、

    感谢您提供的信息、我将在本周进行测试、并将提供星期一的评论。

    此致、

    GREG

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    尊敬的 Greg:

    我们何时可以 收到 测试 结果?
    我 期待着 你的 答复。
    此致、
    Ryu。
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    您好、Ryu、

    您能否发送设置中如何探测电路板的照片?

    此致、

    GREG

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    尊敬的 Greg:

    我们应该 提供什么样的照片?
    此外、 您 怀疑设置的哪个部分 会 影响 该 问题?
    此外 、 您能否 确认 寄存器 设置是否有任何问题?
    除了 这 两个 值之外、所有值都设置为默认值、 但 这些值可能会 影响 问题?
    ・BMCR (寄存器 0x00) = 0x0000
    ・10BOSCH(寄存器 0x1A) = 0x8000
    您 还能否 告知我们 在 EVM 上执行评估时使用的寄存器设置?
    此致、
    Ryu。
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    您好、Ryu、

    理想情况下、最好是有关探头如何连接并放置在电路板上的照片。 有时、探测存在一些不一致之处、可能会产生意想不到的结果。 这些寄存器设置应该不是问题、因为使用相同的寄存器值对 EVM 进行了测试。 您是否知道在 PHY 未处于 SNI 模式时是否发生此问题?

    此致、

    GREG

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    尊敬的 Greg:

    感谢 您的 答复。
    我 已 附上 照片。
    我 知道 这是关于 电阻的。
    此外、 我们 尚未 测试 SNI 模式以外的任何模式 、因为 FPGA 修改 工作 会 很大。
    考虑到 设备发生 故障的可能性 、我们 更换了 设备 、但 仍 出现同样的问题。
    如果 您 能 尽快作出回复、我们将 不胜感激。
    此致、
    Ryu。
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    您好、Ryu、

    我将与我的团队讨论有关此案例的所有当前信息、并就明天的后续步骤提供建议。

    此致、

    GREG

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    您好、Ryu、

    由于器件的遗留性质、遗憾的是、没有有关 SNI 操作的相关信息来 缩小此时序问题的根本原因。

    此致、

    GREG