[参考译文] DP8.3848万YB：有关DP8.3848万YB计时规范的问题

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/575113/dp83848yb-questions-regarding-timing-specs-of-the-dp83848yb

部件号：DP8.3848万YB

客户询问了DP8.3848万YB的计时规格。请参阅下文。

我对DP8.3848万YB数据表中的计时规格有一些疑问。 1) TX_CLK和RX_CLK高/低时间16ns到24ns的定时规格2.4 _1和2.5 _1，这种情况在每个周期之间的变化是否很大，或者在每个周期之间是否相同？例如，如果当前周期为16ns，下一个周期是否为24ns？ 2)此外，我没有看到TX_CLK和RX_CLK的周期抖动的任何计时规格。它是否与连接到X1的振荡器上的输入抖动相同？例如，如果我们使用的振荡器具有20psec的峰间期抖动，那么我们是否应该将20ps的周期抖动添加到TX_CLK和RX_CLK？ 3)此外，MII的设置，保持和输出延迟计时规范，这些计时规范是否已考虑到TX_CLK和RX_CLK上的期间抖动，假设我们符合25MHz振荡器规范(输入抖动小于800psec)？

7 年多前

0 admin 7 年多前

TI__Guru**** 1821780 points

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您好，Brandon：

以下是您的问题的答案：
1. TX_CLK和RX_CLK占空比在IEEE规范22.2 ．2.1 和22.2 ．2.2 中列出。
要求额定20ns高/低，变化范围为14ns至26ns。 DP8.3848万YB在高压和低压侧均将超过此要求2ns。您将完全符合规格。当您在范围和模拟中实际查看它时，我们的TX_CLK和RX_CLK不会随着周期变化太大而变化。
2.在TX_CLK或RX_CLK上看不到足够的抖动，因此无法导致设置/保持失败。 100BASE-TX时25MHz时钟和10BASE-T时2.5MHz时钟有足够的余量在接近看到MAC定时问题之前，您会在MDI (电缆侧)上看到问题。 XI抖动规格将确保您保持足够低的抖动，以便MDI正常工作并通过PMA的抖动规格。
3.设置/保持和输出延迟将为您提供足够的余量。同样，如果您在MII上看到任何明显的抖动，则无法在MDI上链接。我从未在MII上遇到过任何抖动问题。设备将在MII之前断开MDI。

此致，
罗斯

0 admin 7 年多前

TI__Guru**** 1821780 points

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您好Ross：感谢您的回复。我们与客户分享。请参阅以下他的后续行动。

您好，Naser，我还有一个关于DP8.3848万YB的问题，我想添加。数据表未指定VCC以上或地下输入的任何动态过冲规格。它在绝对最大额定值中仅具有-0.5V至VCC+0.5V的直流输入电压(Vin)规范。

许多数据表将具有额外的动态过冲规格，例如-2.0V至VCC+2.0V，持续2秒。您是否可以为此芯片提供类似的规格？

使用您的IBIS模型，我们看到的大约-0.7V的电压小于2nsec，这超出了直流输入规范，需要确定这是否正常，因为它小于2nsec而不是DC。

此致，
Naser

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