This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] TLK106L:以太网通信不稳定

Guru**** 2455560 points
Other Parts Discussed in Thread: TLK106L, TLK106

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/621611/tlk106l-ethernet-communication-not-stable

部件号:TLK106L
主题中讨论的其他部件: TLK106DP8.3822万I

在我的设计中,我在RMII连接中使用TLK106L。
在主板和用于测试的个人计算机之间进行ping测试时,我有“不稳定”行为。
请注意,我在许多设计中都使用了TLK106L,没有任何问题。
我执行了很多测试来查找问题,(最后)它似乎TLK不能正常工作。  

TLK和MAC的时钟源设计为数据表(SLLSEE3D–2013年8月–2016年4月修订)的图6-2。

该问题与定时约束相关,第4.10 章节1通电定时,规格T2:“在VDD斜坡之前,XI时钟必须至少稳定1 µs。”
在我的设计TLK中,MAC和时钟振荡器共享相同的电源,因此不符合T2限制。

可能会发生什么?

感谢您的支持,此致。
Corrado

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好,Corrado,

    要使设备可靠地运行,在开机时需要满足定时约束。
    当您看到“不稳定”行为时:您可以详细说明一下:链接稳定吗?


    此致,
    很棒
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的Geet:

    链路不稳定,我看到丢失了一定百分比的ping。  

    算起来,我有30块板,每个板有2个以太网端口, 60个端口。 关于30 % ,他们的行为"不稳定"。

    在附件中,我们的技术说明,请参阅文件,我希望能够清楚地了解问题。

    谢谢

    此致

    Corradoe2e.ti.com/.../0.0909万_5F00_ISSUE_5F00_00_5F00_00.pdf

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好,

    浏览原理图,查看AVDD3V3和其他几个地方的串联电感器。

    您引入这些功能的原因是什么?
    这些电感器的价值是什么?

    Power也不提供早期的POST时钟,因为您可以尝试在不稳定主板上的POR之前提供时钟,看看它是否有所改善?

    此致,
    很棒
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的Geet:

    电感器是一种铁氧体,用于将数字导轨与模拟导轨分离。 我通常使用此解决方案。

    关于时钟与POR:我们已经做了这个实验,但结果又是“链路不稳定”,请参见附加的波形。

    它是由FPGA逻辑驱动的"RMII_PHY_RST"信号:在此期间时钟保持稳定。

    复位在'0'处驱动10毫秒,PHY在250毫秒后从复位上升沿配置

    最诚挚的问候

    Corrado

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    感谢对铁氧体磁珠的说明。 还可以

    在POR的时钟上,我参考了下面的,在VDD斜坡之前时钟应该可用。

     4.10 µs 1通电计时,规格T2:“在VDD斜坡前,XI时钟必须至少稳定1 μ A。

    您是否也尝试过此体验?

    此致,

    很棒

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的Geet:

    无法分离VDD引脚,我无法在时钟信号后生成VDD斜坡。

    同时,在一个板上,我用 DP8.3822万IRHBT代替TLK106。 它看起来更稳定(到目前为止没有错误),但我只修改了一个主板...

    此外,我还有TL106样本:您认为对测试这些器件是否有用? 您是否可以这样做?

    谢谢

    此致

    Corrado

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好,Corrado,

    如果TLK106在斜坡前没有1US的稳定时钟,您可以看到您描述的问题。
    我认为接收设备没有什么用处,因为应用程序已超出设备的要求。
    您应该不会在DP8.3822万I中看到此限制。

    此致,
    罗斯
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    尊敬的Ross:
    谢谢,我将用DP8.3822万I替换TLK106L。
    使用DP8.3822万I,在VDD斜坡之前无需时钟信号,对吗?
    我希望通过这种方式解决我的问题。
    此致

    Corrado
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好,Corrado,

    您回答正确。 您可以在斜坡时提供时钟信号。

    此致,
    罗斯