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[参考译文] SN65HVD3083E:当噪音进入输入/输出端子(A,B,Z,Y)时IC损坏

Guru**** 2405780 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/667380/sn65hvd3083e-ic-destruction-when-noise-enters-the-input-output-terminals-a-b-z-y

部件号:SN65HVD3083E

你好。

当通信(传输,接收)未完成时,输入/输出端子(A,B,Z,Y)处出现诸如雷击浪涌之类的噪音时。
如果变速器已启用(DE引脚=高),它对IC 故障(销毁)容差是否有效?
如果DE终端的状况与销毁无关,请这样回答。

接收始终启用(RE针脚=低)。

*问题原因
当我不传输时,我想参考如何处理DE终端,以了解它是否有效防止IC销毁。

此致,
DICE K

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    您好,Dice-K:

    感谢您与我们联系。 我不知道我是否正确理解您的问题,因此请告诉我,以防我错了。

    您正在使用收发器SN65HVD3083进行通信,但由于电涌脉冲,无法执行通信。 RE引脚始终保持低电平,这意味着接收器始终启用,您想知道如何处理DE引脚,以提高收发器的稳定性以增强浪涌抗扰性,对吗?

    通常,这些器件是根据JEDEC标准22进行测试的,我们根据引脚配置跟踪每个器件的性能。 在这种情况下,由于设备不是最新的,我必须专门搜索它。 我会很快通知您,脱电状态被拉高或低是否会影响浪涌抗扰性。

    同时,请告诉我我我的理解是否正确。

    谢谢,顺祝商祺!
    Adrian
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    您好Adrian:
    感谢您的回复。 您理解我的问题。

    以下句子是否表示喘振抗扰度的强度与DE是高还是低无关?

    "我会尽快通知您,脱电状态被拉高或低是否会影响浪涌抗扰性。"

    此致,
    DICE K
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    您好,Dice-K:

    我仍在尝试找到正确的文档来回答您的问题。 我只能说在测试阶段,我们会跟踪PIN状态,但在这种情况下,设备相当旧,很难找到文档。

    我会在收到任何信息后立即通知您。

    感谢您的耐心等待!

    此致,

    Adrian

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    您好,Adrian:
    感谢您的支持。

    如果您找到新信息,请让Plesase告诉我。

    此致,
    DICE K

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    您好,Dice-K:

    很显然,很难找到有关如何执行测试的信息,我只能发现,由于DE引脚是一个非电源引脚,因此在我们的测试过程中,它要么被拉至GND,要么浮动。 因此,很遗憾,我们没有针对此设备进行有关电涌测试的偏高测试。
    再次,很抱歉,我们没有使用该针脚状态测试设备,但仅为您所知,我可以参考实际通过了DE高电平和低电平测试的其他设备。 在这些设备中,我们并没有看到收发器在可靠性方面的巨大差异。

    话虽如此,我绝对不是说在这种具体情况下,您会在浪涌抗扰性方面看到完全相同的结果,而只是为您提供其他设备的趋势。

    我希望这能给您更多的想法,如果您有任何其他问题,请告诉我。

    此致,
    Adrian