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[参考译文] TUSB1310A:PCLK波形异常

Guru**** 2478235 points
Other Parts Discussed in Thread: TUSB1310A

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/570336/tusb1310a-abnormal-waveform-of-pclk

部件号:TUSB1310A

您好,

输出PCLK的异常波形,如下所示。

e2e.ti.com/.../PCLK-output.xlsx

条件如下:

-捆扎选项设置为:

  时钟源=时钟, 输入参考时钟频率= 40MHz

外部振荡器频率为40MHz

-PCLK可通过RESETN变为正常

这种异常波形的原因是什么以及对策是什么?

此致,

Kuramochi

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    这种情况怎么样?
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    这种情况怎么样?
    如果您需要更多信息,请告诉我。

    此致,
    Kuramochi
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    您好Kuramochi:
    该信号几乎是正弦波。 请分享原理图。

    此致,
    Gerardo
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    您好,Gerardo,

    他们说这种正弦是被探查影响的。

    与原理图相关,您可能已经确认了原理图。
    您于2016年10月6日或7日向我发送了主题为"TUSB1310A原理图和数据"的电子邮件。

    还有一个附加信息。
    以下设置不会发生这种现象。
    —时钟源:时钟输入
    -参考时钟频率:20MHz
    外部时钟频率:20MHz
    它们假定原因是启动期间捆扎选项设置失败。
    正确吗?

    如果您有任何疑问,请告诉我。

    此致,
    Kuramochi

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    Gerardo-San,

    这种情况如何?
    Kuramochi
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    这种情况如何?
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    您好,Kuramuchi,

    它可以是40MHz的时钟频率。 请确保在REFCLK引脚上选择正确的配置。 我建议您使用20,25或30 MHz。

    请告诉我这些频率是否适合您。

    此致,

    Gerardo

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    您好,Gerado-San,

    感谢您的SUPPROT。

    为什么不推荐40MHz?

    他们选择40MHz,因为在勘误表中启用SSC时,建议使用40MHz,如下所示;

    他们已经安装了40MHz的振荡器,所以他们很难更换振荡器。

    除了将时钟频率从40MHz改为40MHz之外,是否还有其他工作?

    此致,

    Kuramochi

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    Gerado-San,

    这种情况如何?

    此致,
    Kuramochi
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    您好,Kuramochi-san,

    我正在检查您的问题,我将尽快与您联系。

    此致,

    Gerardo

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    您好,Kuramochi-san,

    我知道客户正在使用40 MHz振荡器。 但是,SSC_DIS (扩展频谱时钟)捆扎带引脚绑定到GND,这意味着启用SSC,与勘误表的建议相反。

    或者客户将SSC_DIS逻辑级别更改为高或将时钟更改为其他值(40 MHz)。

    此致,
    Gerardo
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    Gerado-San,

    >但是,SSC_DIS (扩展频谱时钟)捆扎带引脚与GND相连,这意味着SSC启用,与勘误表的建议相反。

    我了解勘误表中建议使用启用SSC的40MHz输入时钟。

    错了吗?

    为什么建议使用 其它值(40 MHz)更改时钟?

    我附上了几个波形。

    e2e.ti.com/.../TUSB1310_E26C625F_.pdf

    您能否确认它是否与此异常PCLK相关。

    此致,

    Kuramochi  

    此致,

    Kuramochi

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    您好Kuramochi:
    请指出所附PDF上的哪些信号与PCLK对应。

    此致,
    Gerardo
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    Gerardo-San,

    很抱歉我的误解。

    您能否确认之前附加的文件,如何设置 捆扎选项是否正确?

    为什么您建议将时钟 更改为40 MHz的其他值?

    此致,

    Kuramochi

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    您好,Kuramochi,

    只是为了澄清。 正如我之前所说,这里的问题是客户有两种选择,我认为:

    A) SSC_DIS逻辑电平太高,使用40 MHz时钟或

    B)时钟 的值不是40 MHz,使SSC_DIS级别保持低。

    此致,

    Gerardo