[参考译文] SN65DSI85-Q1：SN65DSI85 PLL锁定问题

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/565205/sn65dsi85-q1-sn65dsi85-pll-locking-issue

部件号：SN65DSI85-Q1
主题中讨论的其他部件：DS90UB928Q

我的客户正在使用此设备从SoC (DSI)转至我们的DS90UB947 (LVDS)串行器，最终被DS90UB928Q反序列化。我们在打开桥接器和让DSI/LVDS桥接器锁定到DSI CLK时遇到一些问题。我已多次浏览寄存器设置，我确信它们是正确的。对于数据表中的开机顺序，我们不知道如何将DSI CLK和数据引脚置于LP-11状态，因此这可能是问题的根源。任何帮助都很棒！

我计划今天连接参考时钟并尝试生成一个模式。

我已附加注册设置。

感谢您的帮助！

-Joee2e.ti.com/.../DSI_5F00_LVDS_5F00_Bridge_5F00_Settings.txt

8 年多前

0 admin 8 年多前

TI__Guru**** 2391415 points

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您好Joe，

在转换到HS模式之前，MIPI规范要求主机将DSI输出驱动到LP11。初始化/转换顺序要求符合MIPI DPHY (第6.11 节)和DSI (第5.7 节)规范要求。

如果主机将DSI接口驱动为非法状态/协议，则DSI85可能会进入不需要的状态：
－DSI时钟或数据终端启用可能“卡住”
－DSI时钟内部未正确启用

当断言EN (从0转换到1)而DSI CLK = LP00时，可能会发生意外行为。

应按照建议的初始化顺序提供DSI_CLK/数据(初始化seq5，图7)

此致

0 admin 8 年多前

TI__Guru**** 2391415 points

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感谢您的快速回复！

同时，我能否提供参考时钟并使模式生成器在没有任何DSI信号的情况下工作？ REFCLK是否可以从100MHz下分为？

0 admin 8 年多前

TI__Guru**** 2391415 points

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您好Joe，

否，当外部REFCLK用于输出LVDS时钟时，内部PLL将根据REFCLK_multiplier生成输出时钟频率。

作为起点，我建议使用我们的DSI调谐器工具在启用测试模式的情况下生成寄存器配置。

www.ti.com/.../dsi-tuner

此致

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