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[参考译文] DP8.3869万HM：DP8.3869万 Syne.

admin
Guru**** 2455360 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1091885/dp83869hm-dp83869-syne

部件号：DP8.3869万HM
主题中讨论的其他部件：DP8.3869万

您好，TI专家

我们的客户想知道我需要配置DP8.3869万的芯片或寄存器以实现SYNP-E功能的哪种配置，它的恢复时钟输出引脚Rx_clk是吗？ 它可以实现的频率同步精度是多少(标准偏差是多少)。  

非常感谢！

此致，
威廉

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    TI__Guru**** 2455360 points
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    您好，William：

    您可以对reg<0x170>[12:8]= 0x04进行编程，以在设备的CLK_OUT引脚上获得25MHz SyncE时钟。

    让我检查频率的准确性并回复给您。

    －－
    此致，
    Gokul。

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    TI__Guru**** 2455360 points
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    您好 ，Gokul：

    您的意思是恢复的SYNP-E时钟通过clk_out端口输出吗？ 如果我需要125MHz时钟，是否只需要设置reg<0x170>[12:8]=0x00？ 感谢您的回复

    此致，
    威廉

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    TI__Guru**** 2455360 points
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    您好，William：

    是的，您也可以通过编程 reg<0x170>[12:8]=0x00来使用125MHz时钟。

    －－
    此致，
    Gokul。

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    TI__Guru**** 2455360 points
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    您好 ，Gokul：
    感谢您的回复。 我还有两个问题希望你们能回答。 一个是DP8.3869万的SYNP-E频率同步的准确性如何？ 第二点是RX_CLK肯定不会恢复时钟，对吗？ 因为在另一个问答中，它给出了一个答复，即RX_CLK可以用作恢复时钟，我实际上尝试了，但没有工作，我很好奇。
    谢谢！
    此致，
    威廉
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    TI__Guru**** 2455360 points
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    您好，Jiashui，

    RX_CLK将在从属模式(MDI侧)中恢复时钟，可在主模式(MDI侧)中用作SyncE时钟和主时钟。 我猜设备处于主模式，无法正常工作。

    您可以将CLK_OUT与上述寄存器写入一起使用，以始终获得独立于主/从的恢复时钟。

    让我检查一下准确性并回复给您。

    －－
    此致，
    Gokul。

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    TI__Guru**** 2455360 points
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    你好，Gokul。
    感谢您的快速回复，我们的客户还有其他问题：
    我尝试更改reg<0x170>的寄存器，但没有好的方法来确保我的更改成功，我使用的软件无法访问扩展寄存器，并且读取的值错误。 我更改寄存器的方式是通过驱动程序更改它。 官方驱动程序和设备树建议指出了如何更改它。 通过驱动程序中的打印信息，我可以观察到reg<0x170>=0，这应该是正确的值，但无论我如何更改寄存器，通过测量clk_out获得的值始终为25MHz。 同时，我尝试将reg<0x9>和reg<0x10>更改为MDI从属模式，但Rx_clk恢复的时钟仍然没有明显的效果。
    基于上述，我想问您两个问题：
    1.有没有方法读取和写入嵌入式系统中PHY芯片的扩展寄存器信息？
    2.如果要将rx_clk更改为恢复时钟，如何配置寄存器？
    谢谢你，提前！
    此致，
    威廉
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    TI__Guru**** 2455360 points
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    您好William：

    您可以使用以下方法对扩展寄存器进行编程

    例如，您要编程(MMD，ADDR)=(1F，YYYY)，数据= ZZZZ，然后编程

    写入0x000D = 0x001F
    写入0x000E = 0xYYYY
    写入0x000D = 0x401F
    写入0x000E = 0xZZZZ

    例如，您要读取(MMD，ADDR)=(1F，YYYY)

    写入0x000D = 0x001F
    写入0x000E = 0xYYYY
    写入0x000D = 0x401F
    读取0x000E

    您提到当您将设备更改为从属设备时没有明显的影响。 由于两个时钟都是25MHz，您看不到任何变化。 您是否测量了抖动以查看抖动配置文件是否发生了变化？

    －－
    此致，
    Gokul。

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    TI__Guru**** 2455360 points
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    你好，Gokul。

    我们的客户回复如下：

    PS：连接到网络时，串行端口调试助手上将显示以下提示：

    macb e000c000.ethernet eth0：无法生成目标频率：1.25亿 Hz

    macb e000c000.ethernet eth0：链路连接(1000/Full)

    IPv6：ADDRCONF (NETDEV_CHANGE)：eth0：链路准备就绪

    我不确定这是否会影响其恢复的时钟？

    非常感谢！

    此致，
    Gokul。

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    你好，Gokul。

    很抱歉，请忽略以上信息，我们的客户在下面回复：

    通过您提供的方法，我读取了芯片reg<0x170>的值，我可以获得正是我需要的值，即0x0，但通过测量clk_out引脚获得的时钟信号始终为25MHz，而不是125MHz。 我尝试将reg<0x170>的值设置为0x400和0x800，分别代表恢复时钟的1/5和传输时钟，但是，我在clk_out引脚上测量的时钟仍保持在25MHz。 我可以问，原因可能是什么？ 我将测量一些基本的注册信息以进行分析，希望您能提出一些建议。
    PS：我现在只应用RGMII到铜缆模式
    (25MHz时钟的测量与MDI从属模式无关。 当我将其设置为MDI从模式时，使用的恢复时钟是RX_CLK而不是CLK_OUT，但此方法也不起作用，我仍需要知道SyncE可以实现什么。频率同步准确性)
    下面是我测量的寄存器的值，我希望它能起作用
    地址 值与重置相同
    01140  
    17949  
    2000 年2日
    3  a0f1
    4  01e1  x
    50000  
    60066   x
    72001 年
    80000   x
    9  0a00  x
    a  0000
    d  401F  
    e  0800
    f  F000  
    105048  
    111002   x
    120000  
    13  1dc4  x
    14  29c7.
    150000  
    160000  
    170040  
    186150  
    194444 .
    1A  0002
    1E  0012.
    1f  0000
    扩展
    250480  
    2C  141 f
    32  00d0
    6e  0000
    17.008万 0
    1df  0000
    1E0417 A

    PS：连接到网络时，串行端口调试助手上将显示以下提示：

    macb e000c000.ethernet eth0：无法生成目标频率：1.25亿 Hz

    macb e000c000.ethernet eth0：链路连接(1000/Full)

    IPv6：ADDRCONF (NETDEV_CHANGE)：eth0：链路准备就绪

    我不确定这是否会影响其恢复的时钟？

    非常感谢！

    此致，
    威廉

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    您好 ，William：

    让我在这里尝试相同的方法，并在周三之前回复您。

    －－
    此致，
    Gokul。

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    你好，Gokul。

    谢谢您，我将等待您的回复。

    再次感谢！


    此致，
    威廉

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    您好，William：

    您能否告诉我SyncE的最终使用案例？ 客户是否对25MHz恢复时钟或125MHz恢复时钟感兴趣？

    CLKOUT是否需要时钟？  

    我可以在实验室中专门测试这种情况，以查看观察到的预期行为。

    －－
    此致，
    Gokul。

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    你好，Gokul。

     是的，我需要获取SyncE时钟作为IEEE1588时钟同步硬件时间戳的标记；根据另一个问题和答案，我已经解决了CLK_OUT端口生成125MHz时钟的问题。

    根据您的描述，有两种方法可获得SyncE时钟：1. CLK_OUT端口恢复时钟；2. RX_CLK恢复时钟，但需要将模式更改为MDI从属模式。

    我暂时不能尝试第一种方法，因为我没有跟踪集来将时钟带到我的主板上；我尝试了第二种方法，但没有得到我想要的结果；并将主控设置为手动MDIX； 从属设备在设置为手动MDI后，它们之间的数据包丢失率会上升。

    在这个阶段，我正在重新设计板，以便将从CLK_OUT获得的时钟引入板；我想从您那里得到的帮助是：1. 如何正确配置第二种获取SyncE恢复时钟的方法？ 2.通过DP8.3869万恢复的SyncE时钟可实现哪种频率同步准确性？

    感谢您的回答！

    此致，
    威廉

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    您好，William：

    您提到您需要标准偏差方面的准确性，对吗？ 在数据表中，我们具有抖动方面的准确性。 我目前没有标准偏差，明天必须收集该数据。  

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    你好，Gokul。

    好的，感谢您的信息， 我们很高兴能有您在TI公司工作
    此致，
    威廉

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    您好，William：

    谢谢！ 我将在今天结束之前提供这些信息。

    －－
    此致，
    Gokul。

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    您好，William：

    最坏情况下SyncE时钟的标准偏差为~100ps。

    －－
    此致，
    Gokul。

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    您好 Gokul

    是的，我需要获取SyncE时钟作为IEEE1588时钟同步硬件时间戳的标记；根据另一个问题和答案，我已经解决了CLK_OUT端口生成125MHz时钟的问题。

    根据您的描述，有两种方法可获得SyncE时钟：1. CLK_OUT端口恢复时钟；2. RX_CLK恢复时钟，但需要将模式更改为MDI从属模式。

    我暂时不能尝试第一种方法，因为我没有跟踪集来将时钟带到我的主板上；我尝试了第二种方法，但没有得到我想要的结果；并将主控设置为手动MDIX； 从属设备在设置为手动MDI后，它们之间的数据包丢失率会上升。

    在这个阶段，我正在重新设计板，以便将从CLK_OUT获得的时钟引入板；我想从您那里得到的帮助是：1. 如何正确配置第二种获取SyncE恢复时钟的方法？ 2.通过DP8.3869万恢复的SyncE时钟可实现哪种频率同步准确性？

    感谢您的回答！

    此致，
    威廉

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    您好 Gokul
    很抱歉，最后一封电子邮件重复，请忽略它。请帮助解决以下问题：
    非常感谢您对测试的帮助！
    我希望我能得到相同的标准偏差，所以我想询问您的测试计划和具体的配置方法，谢谢！
    此致，
    威廉
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    您好，William：

    在我的测试中，我将2个DP8.3867万 EVM与其来自不同来源的输入时钟进行了链接，并具有一定的频率偏移。

    我在CLK_OUT引脚上获得了125MHz恢复时钟，并使用示波器测量时钟输出的连接。

    －－
    此致，
    Gokul。

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    您好 Gokul
    感谢您的回复！
    但是，我不太理解您的意思，连接到两个EVM板的时钟是否来自不同的时钟源？ 如下面的图1所示，这两个是否通信？
    根据我的理解，两个EVM板应该连接在一起，如下面的图2所示。
    或者您是否为两个CLKOUT设置了不同的寄存器？

    我知道已恢复的时钟是从网络中的RX_CLK恢复的。 我的理解是否错误？

    此致，
    威廉

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    您好，William：

    很抱歉混淆了。 您显示的第一个图像是我用于测试的设置。

    我所说的是对XI的输入，即clk1和clk2，它们来自不同的外部源，具有ppm偏移。
    目前，您无需使用不同的时钟，而是使用晶体进行时钟源。

    －－
    此致，
    Gokul。

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    您好 Gokul
    感谢您的回复。
    根据你的解释，我不理解以下几点：
    1.测试时，两块EVM板是否未通过网络端口进行通信？
    2.两个EVM板的REG<0x170>是什么？
    同时，我根据我的测试方案进行了测试：
    首先，我使用了两块DP8.3869万板，时钟源使用自己的时钟源，并通过以下方式获得125MHz时钟：
    0xD10 -> reg<0x170>
    0x10 -> reg<0xC6>
    以下是前一个问题的解决方案，即您无法生成125MHz时钟；
    然后，通过网络电缆连接两块板以实现通信，并将板1和板2的REG<0x170>分别设置为0x800和0x0；
    最后，我通过示波器单独运行以下两项测试：
    1.在网络电缆连接的情况下，测试两个时钟的延迟时间；
    2.断开网线后，测试两个时钟的延迟时间；
    获得以下图1和图2；
    根据上述测试，我想问您两个问题：
    1.测试1能否显示DP8.3869万主板的SyncE恢复时钟；
    2.在图2中，两个时钟不能同时保持稳定。 原因是什么？ 是否是因为频率不一致？
    我的测试计划是否正确？
    感谢您如此负责任的回复！
    此致，
    威廉
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    您好，William：

    根据我的理解，您正在测量发射/恢复时钟或板-1与板-2的恢复/同步时钟之间的延迟。

    当电缆连接在它们之间并且电路板连接在一起时，所有频率都将对齐，因此您会看到固定的延迟。
    断开电缆连接时，不会对齐1号板和2号板的时钟。 这是由于两块板之间的频率不匹配。 任何较小的频率偏移都将使时钟看起来与肉眼不同步。

    因此，总的来说，我认为您能够观察到系统中的目标。

    －－
    此致，
    Gokul。

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    您好 Gokul
    感谢您的回答，我暂时解决了所有现有问题并得出了一些结论：
    1.根据您的答案，在DP8.3869万中，可以通过两种方式获得SyncE恢复时钟，即恢复RX_CLK时钟(但发送端和接收端分别需要配置为MDI-master和slave端)； 我最终没有实施此解决方案)，并通过CLKOUT端口恢复时钟。
    2. CLKOUT端口输出时钟的配置方法是配置reg<0x170>寄存器，但我遇到了第二个问题，即125MHz的时钟无法输出；此问题通过阅读其它问题和答案(即)得到了解决
    0xD10 -> reg<0x170>
    0x10->reg<0xC6>；
    完成此操作后，可以获得125MHz的时钟输出；
    3.您还回答了如何配置扩展寄存器的问题，即
    例如，您要编程(MMD，ADDR)=(1F，YYYY)，数据= ZZZZ，然后编程
    写入0x000D = 0x001F
    写入0x000E = 0xYYYY
    写入0x000D = 0x401F
    写入0x000E = 0xZZZZ
    例如，您要读取(MMD，ADDR)=(1F，YYYY)
    写入0x000D = 0x001F
    写入0x000E = 0xYYYY
    写入0x000D = 0x401F
    读取0x000E；
    4.通过测试方法，可在100ps内测量两个时钟系带的标准偏差；
    目前，我的一些现有问题已经得到回答，但我仍然没有机会验证CLKOUT恢复时钟是否可以实现频率同步，这需要我等待一端进行验证； 我还想问如何测试时钟表，我在示波器上找不到这个测试按钮；
    衷心感谢您的所有回答，谢谢！
    此致，
    威廉
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    您好，William：

    乐于助人！ 如有任何其他疑问/说明，请联系我。

    －－
    此致，
    Gokul。