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[参考译文] TLK10081:支持5.12Gbps 的高速端 SERDES 线路速率

Guru**** 2826855 points

Other Parts Discussed in Thread: TLK10081

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1106839/tlk10081-support-for-high-speed-side-serdes-line-rate-of-5-12gbps

器件型号:TLK10081

美好的一天!  

我想将低速端的8x 640Mbps 链路聚合到高速端的单个5.12Gbps 链路中。  根据表5.2和5.3、我所需的5.12Gbps 略微超出了支持的 PLL 范围。 在此处提到的演示(连接:使用通用串行器/解串器进行数据聚合-模拟-技术文章- TI E2E 支持论坛)中、使用类似的 TI 器件实现了5.94Gbps (也超出 PLL 范围)的高速链路。 我的问题如下;是否可以使用 TLK10081实现5.12Gbps 高速链路? 如果不是、是否有可供考虑的替代方案?

此致、  

Boris  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Boris、

    遗憾的是、我不建议将 TLK10081用于5.12Gbps 链路。  尽管我没有参与5.94Gbps 链路的演示、但我怀疑这是一种功能配置、因为这涉及使用略低于6Gbps 最小数据速率的器件。  要实现5.12Gbps 链路、需要以10.24GHz 的频率运行 PLL、然后使用半速率设置。  即使 PLL 在此数据速率下工作、某些 SERDES 功能也可能无法按预期工作。

    不幸的是,我不知道这部分的任何替代办法。

    谢谢、

    Drew