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[参考译文] DP83826I:加电序列

Guru**** 2393095 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1105933/dp83826i-power-up-sequence

器件型号:DP83826I

团队、

我的客户对 AVDD3V3和 VDDIO 电压序列有疑问。 它们按以下顺序为器件加电、如果可以、则需要进行调整

  1. VDDIO 从1.8V 开始。
  2. 几毫秒后、AVDD3V3以2.5V 开始
  3. 几个月后、AVDD3V3将达到3.3V

在此期间、PHY 由具有下拉电阻的 GPIO 保持在复位状态。 它们计划在所有电压被正确初始化后释放复位。

此致

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    您好、Franziskus、

    数据表中列出了所有时序和启动要求。

    请确保客户满足所有标准、以确保操作正确。  

    最棒的

    Alon  

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    您好、Alon、

    感谢您的回答! 我想我的问题的要点如下:

    • 由于它们 的 AVDD3V3 首先斜升至2.5V、然后斜升至3.3V、我想3.3V 的总时间不应超过200ms、对吧?
      • 到2.5V 的中间阶跃是否存在问题?
    • 如果器件始终处于复位状态并且仅在所有电压稳定时才释放、则加电时序是否适用?

    此致

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    您好、Franziskus、

    是的、只要不超过200ms、就不会成为问题。  

    这话什么意思  

    [~ userid="71087" URL"/support/interface-group/interface/f/interface-forum/1105933/dp83826i-power-up-sequence/4098226#4098226"]如果器件始终处于复位状态并且仅在所有电压稳定时才会释放、则加电时序是否适用?

    如果器件未上电、您如何进行复位? 您是说在整个启动时间有复位信号吗? 我不知道这样做会产生什么影响,但我不明白为什么这应该是一个问题。

    最棒的

    Alon  

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    您好、Alon、

    谢谢! 正确、它们在整个启动过程中保持 RST_N 引脚为低电平、并且仅在  AVDD3V3为3.3V 时才释放该引脚。

    在这种情况下、200ms 的要求也适用吗?

    此致

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    您好、Franziskus、

    我认为它不会导致任何问题、但是、鉴于数据表中没有直接解决、我无法保证、我稍后会询问团队、如果我有更具体的答案、我将更新。

    默认情况下、我不建议这样做、但是、如果客户对其进行测试并且它正常工作、那么我看不到在您在正确的时间释放复位时、它会导致更多问题的原因。  

    最棒的

    Alon

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    谢谢你 Alon!

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    Alon、

    我有一个后续问题:

    遗憾的是、我的客户在 VDDIO 从2.5V 导通至3.3V 后、直到大约500-700ms 才能提出 AVDD3V3。 这明显高于200ms 的最大值、但我仍然想知道每次打开系统时、如果超过此限制、会有什么问题。 如果初始化出现故障、它们可能能够在稍后纠正初始化。

    此致

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    您好、Franziskus、

    如果不满足数据表中列出的时序要求、则可能会使 PHY 的状态机卡在未知状态。  

    如果不关闭 PHY 并使用正确的过程重新初始化、则不一定有办法修复它。  

    最棒的

    Alon

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    您好、Alon、

    好的、明白了!

    新思路:当使用内部 LDO 为  VDDIO 供电时、您是否发现 AVDD3V3在500-700ms 后首先变为2.5V、然后变为3.3V 有任何问题?

    此致

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    您好、Franziskus、

    必须满足每个数据表要求、以确保 PHY 正确运行、如果数据表未具体解决此问题、 然后、我们只能评论您尝试后会发生什么、因为我们尚未在内部测试这些条件、因此无法预测 PHY 将如何反应。

    从理论上讲、如果数据表中没有提到您无法做到这一点、并且您满足所有功率斜坡要求、那么 理论 上我不能想到它不起作用的原因。  

    最棒的

    Alon

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    谢谢!