Other Parts Discussed in Thread: DP83867E
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器件型号：DP83867E 下午好！
我们在电路板上使用的是20个 DP83867E。 我们使用一个 MDC-MDIO 接口控制10个 PHY、使用另一个 MDC MDIO 接口控制5个 PHY、使用另一个 MDC-MDIO 接口控制另外5个 PHY。 它们都由同一 FPGA 进行控制。
这20个 PHY 连接了20个其他板。 我们也有相同的 PHY。
有时在启动时，一个或多个链路未连接，一旦我们尝试读取 PHY 的 ID，我们就会从 PHY 的 FFFF 读取所有寄存器。 我们尝试禁用并启用无法正常工作的 PHY (使用断电引脚)、我们看到问题仍然存在、 重启通常可以解决问题(我们可以再次从 PHY 读取正确的数据)。
您能告诉我们哪些可能的情况会阻止 PHY 并导致从 MDIO 读取 FFF 吗？
我们进一步调查此问题、我们有一些意见可能会帮助您向我们提供一些反馈。
1) 1)我们使用3电源模式、同时启用1V8和2V5电源。 但1V8比2V5运行最小范围(2.375)早约70us 达到 PHY 的运行最小限值(1.71V)。
2) 2)我们不会从 FPGA 对 PHY 进行复位、复位信号通过1V8轨(即 IO 电压电平)上拉。
3) 3)我还看到有一个断电要求、即 在为 DP83867断电时、1.8V 电源应在2.5V 电源之前关闭。 下降意味着超出运行限制或下降至0V 或其他情况？
图片是1V8和2V5的上电和断电场景。 如果看不到照片，我可以发送电子邮件
如果您认为其他一些测量可能有助于调查更多信息、请告知我们。
此致、
Onur Kusakoglu
