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[参考译文] SN65MLVD203B:D 线下拉逻辑信号

Guru**** 2434190 points
Other Parts Discussed in Thread: SN65MLVD203B

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1133680/sn65mlvd203b-d-line-pulls-down-logical-signal

器件型号:SN65MLVD203B

您好!

几周前,我在这个论坛主题上有一些问题:

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1089599/sn65mlvd207-bidirected-signal-with-one-wire/

我对原理图进行了一些更改、现在出现了一个新问题。

我想简要介绍一下我的原理图:

将通过总线驱动器“74LVC2G125”(U3)从“数据 A2”发送逻辑信号。 然后、信号应从 SN65MLVD203B (U1.1)进入 D 输入。 芯片 U1连接到与 U1具有相同逻辑星座的相应器件 U5。 (这就是为什么我没有从 U5中得出逻辑方面的结果)。 因此、当 U1.2的 R 线路未接收到任何信号时、U2仅允许通过 U1.1的 D 输入传输信号。 总线驱动 U4用作二极管、因此信号只能沿一个方向传输。

我的问题是 U1的 R 线输入。 首先、我的原理图中没有 U3、但我觉得 D 线会拉低任何类型的逻辑信号。 以确保我添加了 U3芯片。

我从示波器中截屏:

在蓝色通道上、来自微控制器的逻辑信号可以看到(3.3V)。 红色信号是 U3的输出、也是 D 线的输入电平。 我不清楚为什么逻辑信号比数据信号低得多。 在添加总线驱动器 U3之前、我使用了一个频率发生器、我必须将频率输出电压提高到4.5伏、才能在 D 线上获得3.3V 输入信号。

因此、我认为 U1的 D 线会将信号拉低至0V。

有人是否知道这可能是什么原因? 我的 SN65MLVD203B 是否可能损坏? 但因此、我用全新的试验器件更换了芯片、然后得到相同的结果。

此致、

Marcel

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    尊敬的 Marcel:

    当您更换芯片时、您是否还提供4.5V 电压? 如果是、请注意、这超出了数据表中建议的工作条件以及绝对最大额定值。

    此外、再次确认 LVC 器件根据 OE 配置为 U3输出和 U4输入。 但是、您是否有接收器和驱动器反向用于总线争用的机会? 如果是、请参阅《 如何使用3.3V LVDS 驱动器/接收器+电平转换  器支持1.8V 信号》、以进一步帮助实施、谢谢。

    此致、

    Michael。

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    您好、Michael、

    我从未将4.5伏电压连接到 SN65MLVD203B。 我必须将内部频率发生器增加到4.5伏、以便在 D 引脚上具有3.3伏的电压。 我在示波器上放置了一条测量线。 因此、我绝不能将电压设置为高于3.3伏。 (这些是蓝色信号上的两条虚线)看起来就像 D 引脚上存在一个到 GND 的低阻抗连接。

    U3和 U4的 OE 引脚连接到 GND、因此它们始终处于激活状态。

    正如我写的那样、微控制器信号直接连接到引脚 D (5)。 一旦我将该信号连接到引脚5、3.3V 电压就会降至2V 以下。 这就是为什么我添加 U3芯片、以便微控制器信号稳定在3.3V。 但是、U3的输出电压会降至2伏以下。 芯片 U1和 U5具有完全相同的接线。 我创建了两个测试板:

    具有微控制器板的完整环境:

    所有三个电路板的电源电压均为3.3V、由电源供电。

    我无法解释电压为什么会降到2伏以下。

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    尊敬的 Marcel:

    您能帮您分享完整的原理图吗?

    不过、也请帮助比较您的端接电阻与 MLVDS 器件推荐的50欧姆电阻、谢谢。

    此致、

    Michael。

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    尊敬的 Marcel:

    此外、如果您使用的是203或203B、您是否可以帮助实现双重合规? 如果是203B、请注意以下引脚分配、谢谢。

    此致、

    Michael。