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[参考译文] DP83826I:将双绞线内的导线交换为 DP83826I phy 芯片

Guru**** 657500 points
Other Parts Discussed in Thread: DP83826I, DP83847
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1053682/dp83826i-swapping-the-wires-within-the-twisted-pair-about-dp83826i-phy-chip

器件型号:DP83826I
主题中讨论的其他器件: DP83847

尊敬的团队:

大家好、 我对 DP83826I 器件有一些问题。

DP83826I 数据表指出:交换双绞线内的导线会导致极性误差。 但是、100BASE-TX 不受极性问题的影响、因为它使用 MLT-3编码。
您能告诉我更多有关这方面的信息吗? 当使用 MLT-3编码时、我不知道为什么不会出现问题的确切原因、即使极性已更改并应用到 PHY 芯片上也是如此。


2.我们想查询数据表页.33中的 RMII 从器件信号图像。
在 RMII 受控模式中、它被称为"PHY 可以通过主机 MAC 提供的50MHz 时钟运行"。
但是、通过查看图像、可以确认 MAC 和 PHY 是双向连接到"50MHz 参考时钟"部分的。
这似乎与上述解释相冲突,哪一个是正确的?

感谢您的回复和辛勤工作。

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    您好!

    关于您的问题:

    1) 1) DP83826具有极性检测和校正功能。 这意味着在 MDI 网络(引脚4-7)上、引脚4和5信号可以相互交换(这意味着正信号可以变为负信号、反之亦然)。 引脚6和7具有相同的功能。 实现此功能的原因是为了使布局更轻松地达到 RJ-45 (例如、为了防止 MDI 布线过孔)。 我们的 PHY 可以检测极性开关并对其进行调整。

    2) 2)对于 RMII 从器件配置、必须为 DP83826的 XI 提供50MHz 时钟。 该时钟必须直接来自 MAC、也可以与 MAC 关闭时钟相同。 您参考的图9-5展示了后一种情况。

    此致、

    Gerome

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    感谢您的回复。

    我对该函数及其原因有足够的了解。

    但是、正如注释中所述、由于采用 MLT-3编码方法、极性交叉是可能的、我想进一步了解这一点。

    请问 MLT-3编码的原理是什么使极性交叉成为可能?

    感谢您的回复。

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    以下摘自 DP83847数据表。

    『二进制到 MLT-3的转换是通过将 NRZI 编码器的串行二进制数据流输出转换为两个二进制数据流来完成的、并交替进行逻辑一事件。 然后、这两个二进制流被馈送到双绞线输出驱动器、该驱动器将电压转换为电流、并交替驱动发送变压器初级绕组的任一侧、从而实现最小电流(最大20mA)的 MLT-3信号。』

    为什么在使用 MLT-3编码的网络中可以进行极性交换?

    这是因为即使由于 TX+和 TX-信号最终分别连接到 binary_plus 和 binary_minus 而发生 TX 极性交换、从差分 MLT-3接收到的最终信息还是相同的?

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    您好!

    MLT-3使用信号方案、只要在时钟的上升沿期间数据为"1"、就会在{0、+1、0、-1}的模式下循环。 如果数据为"0"、则输出将保持原样。 我们的 PHY 使用差分对来实现 MDI 、其中我们有正负信号。 标准公约是积极的,相反极点则是消极的。 在该方案中、重要的是转换的事实、解码后会产生"1"、因此您可以看到极性无关紧要。

    此致、

    Gerome