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[参考译文] LMH0050:PLL 不能锁定并且 SMB 中的部件标识不正确

Guru**** 2551110 points
Other Parts Discussed in Thread: LMH0050, LMH0040

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1136414/lmh0050-pll-doesn-t-lock-and-incorrect-part-identification-from-smb

器件型号:LMH0050
主题中讨论的其他器件: LMH0040

我的设计中有一个 LMH0050、它将 Xilinx Zynq-7中的数据串行化为 HD-SDI、然后输出到监视器。

Zynq 具有连接到 LMH0050的 RSTN、LOCKn、SMB SCL/SDA 和所有 LVDS 对的 GPIO。  它还控制 IC 的低纹波电源的使能。

起初、我认为我根本不需要为我的目的配置 SMB、但在尝试切换 ENABLE、RSTN 和 TXCLK (27和148.5MHz)的每个变体后、LMH 根本没有响应、LOCKn 保持高电平、TXOUT 不执行任何操作。 (我还将测试图形视频传递给 TX 数据对)

通过 SMB 探测寄存器我发现无论我做什么、LOS 状态寄存器返回0x00、这表示即使我知道我不提供任何数据、芯片也会检测 TX 线上的数据和时钟。  事件状态寄存器还指示 TXCLK 上有一个时钟、但与 LOCKn 输出一致、即 PLL 永远不能锁定。  最后、芯片识别寄存器返回我的系统中有一个 LMH0040、但封装标记为 LMH0050。

我有一个损耗、在靠近 IC 的位置进行探测表明我正在为其提供我认为需要的输入。  是否有任何关于下一步尝试的想法?

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    你好、Zach、

    我一直在思考这个问题。 我想只要您具有+/-500ppm 的正确时钟速率、我们就应该能够锁定。 我假设情况是这样。 唯一需要注意的是、保留引脚、DNC、DVB-ASI、环路滤波器电容连接或器件周围的其他一些引脚可能未正确偏置。 很抱歉、这些是我想到的、我无法直接指出这里的问题。

    此致、Nasser

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    对此进行了更新。  我继续检查一下、如果我禁用寄存器0x27中的 FIFO 错误、PLL 会锁定、尽管我在输出上仍然没有任何移动。

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    您好、Zack、

    请确认您正在使用500ppm 以内的发送时钟。  

    此外、您还在使用常规颜色条模式?

    此外、您是否使用示例 FPGA 代码来初始化器件? 如果您能让我们了解整个方框图、那将会更好。

    此致、Nasser

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    我正在使用50ppm 以内的发送时钟。

    我仅使用您的示例 RTL 为 IC 提供数据和时钟。

    我已经尝试了多种测试模式、每种模式都是从我自己的 IP 生成的。

    SMB 总线由标准 Xilinx IIC IP 控制。

    我使用逻辑分析仪探测 LOCKn、发现 PLL 可以锁定几千个周期、但随后会随机失去锁定。  我无法识别它相对于传入视频数据获取或失去锁定的任何模式。

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    您好、Zack、

    示例我认为 Xilinx IP 也会生成色条图形-在器件初始化后。 您可能希望让示例 IP 执行初始化和模式生成-看看我们是否可以保持锁定。

    有两个原因不能保持 CDR 锁定:传入数据或参考时钟上的抖动太大。 最好将参考时钟或 LVDS 数据放置在无限持久性范围上、以查看是否存在会导致器件失锁的高抖动。

    此致、Nasser

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    纳赛尔

    感谢您的故障排除、但毕竟这似乎是一个电气问题。

    我在尝试探测时不小心炸了 IC、我们更换了它。  现在工作正常。  最好的猜测是、一个或多个引脚已桥接至下方的接地焊盘、并且更换的 IC 已不再正确。

    在任何情况下、LMH0050现在都可以正常工作、我将转到下一个下游器件。

    -扎赫