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[参考译文] DP83867IR:1V8 IO 下的 DP83867IRRGZR VIL 电平

Guru**** 2768825 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1026416/dp83867ir-dp83867irrgzr-vil-levels-at-1v8-io

器件型号:DP83867IR

尊敬的先生/女士:

DP83867IRRGZR 的数据表指出、当使用1V8的 IO 电压时、VIL 最大阈值-> 0.2 * Vcc = 0.36V。 是这样吗? 这看起来非常低、几乎无法与其他器件正确连接(例如、Xilinx 7系列 FPGA 在1V8 IO 电平下的 VOL 最大值为0.45V)。

此致

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    您好、Tom、

    为您的 FPGA 提供了什么电流电平的 VOL 规格?

    谢谢、

    卢卡斯

    此通信和任何相关通信中的所有信息均按“原样”和“不含任何瑕疵”提供,并受 TI 的重要声明(http://www.ti.com/corp/docs/legal/important-notice.shtml)约束。

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    您好 Lucas、

    感谢您的供应、很抱歉我生病了几天。 使用的 FPGA 是 Xilinx Zynq XCZU5EG、此处未指定特定电流。

    在我看来、在比较不同 IO 电源电压下的电平时、DP83867的 VIL 电压会发生如此大的跳变、这也是很奇怪的:

    VIL @3.3V = 0.7V;VIL @2.5V = 0.7V;VIL @1.8V = 0.2*VDDIO = 360mV

    对于 VIL 最大值、360mV 似乎非常低、同时考虑到在1.8V 下运行的器件的典型 VOL 最大值。

    此致、

    Tom

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    您好、Tom、

    我已在内部就您的问题进行了讨论、并将很快返回给您。

    谢谢、

    卢卡斯

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