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器件型号:DS160PR822 您好!
我将 在新设计中使用 DS160PR822NJXR。 我看到链路完全不稳定、 从 L0到恢复到 L0。 我尝试了所有设置、但运气不好。 这是我的设置
Xilinx V7 FPGA (GTH)<->1m 电缆<->DS160PR822 <->PCIe Gen3功能端点。
请在此处提供帮助。
此致、
斯里哈兰
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您好!
我将 在新设计中使用 DS160PR822NJXR。 我看到链路完全不稳定、 从 L0到恢复到 L0。 我尝试了所有设置、但运气不好。 这是我的设置
Xilinx V7 FPGA (GTH)<->1m 电缆<->DS160PR822 <->PCIe Gen3功能端点。
请在此处提供帮助。
此致、
斯里哈兰
你好,西里沙兰,
在第3代、我应该会有稳定的 L0会话。
1)。 是否有任何方法强制第1代或第2代确保没有链路恢复?
2)。 请确保1m 电缆插入损耗在限制范围内(<22dB)?
2)。 是否可以使用更短的电缆长度来检查电缆插入损耗是否相关?
3)。 我不确定您是否已经完成了信号完整性研究、以确保您的电缆、连接器和 PCB 材料能够满足这些插入损耗要求。
请告诉我。
此致、Nasser