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器件型号：LMH1228 主题中讨论的其他器件： SIGCONARCHITECT
大家好、团队、
客户 FPGA 中的 IP 内核只能处理 SPI 的32位长度数据、而不能处理17位长度。
如果 R/W 位、地址和数据被像下面那样放置在最后的17位上、那么 LMH1228能否与处理器正常通信？
SS_N 在发送32位数据之前被拉低、而在结束32位数据后被拉高。
此致、
Saito
