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[参考译文] SN65DP159:如何在 PC 待机模式下降低功耗

Guru**** 2540720 points
Other Parts Discussed in Thread: SN65DP159

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/870968/sn65dp159-how-to-reduce-the-power-consumption-in-stand-by-mode-of-pc

器件型号:SN65DP159

SN65DP159规定、在断电模式下、器件功耗典型值为10mW、最大值为30mW。 但根据我们的客户意见、该规格高于我们竞争对手器件的器件功率。

下面是他们在待机模式下降低器件功耗的想法、在 VDD 引脚和 VCC 引脚上添加 FET 开关。 其目标器件功耗小于5mW。 作为参考、竞争对手的器件功耗低于最大值1mW。

向 VDD 和 VCC 引脚添加 FET 开关时会出现什么问题?

他们需要了解什么?

你有什么好主意吗?

请向我提供有关降低器件功耗的建议。

谢谢

TAMIO  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Tamio-San

    您可以使用 FET 开关来控制 VCC 和 VDD 电源、请确保在从待机状态唤醒时遵循上电序列。

    谢谢

    David

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    大家好、David、

    感谢您的快速回复。

    是的、我将向客户反馈、以便他们在从待机模式唤醒时注意上电序列。  

    谢谢

    TAMIO