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[参考译文] SN65DPHY440SS：当 MIPI 通道速度为360Mbps 时、DPHY 重定时器(SN65DPHY440SS)与 CSI-2接收器之间的最大距离

admin
Guru**** 2551110 points
Other Parts Discussed in Thread: SN65DPHY440SS

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/915300/sn65dphy440ss-max-distance-between-dphy-retimer-sn65dphy440ss-and-csi-2-sink-when-mipi-lane-speed-360mbps

器件型号：SN65DPHY440SS

您好！

计划在 我们的设计中使用 DPHY 重定时器 SN65DPHY440SS。 我们将 NVIDIA TX1模块用于 CSI-2灌电流。 由于我们使用的是处理器模块、因此我们无法将 DPHY 重定时器放置在靠近 NVIDIA 处理器的位置。

DPHY 重定时器和6英寸 NVIDIA 处理器之间可以放置最接近的位置。  我们的摄像头传感器速率为360Mbps。  

我想知道、当 MIPI 速度为360Mbps 时、DPHY 重定时器和处理器之间的最大距离是多少？

请建议所需的引脚配置 VSADJ_CFG0、 PRE_CFG1、EQ/SCL、 ERC/SDA、以实现360Mbps 速率以及重定时器和处理器之间的6英寸距离

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    TI__Guru**** 2551110 points
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    您好！

    在360Mbps 数据速率下运行的6in 跟踪没有问题。 DPHY440具有 RX 均衡器、可帮助补偿6英寸插入损耗。 根据插入损耗的不同、设置为 VIM 的 EQ 应该足够了。

    我建议在配置引脚上使用上拉/下拉选项、以便我们可以根据需要调整 DPHY440。

    谢谢

    David

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    TI__Guru**** 2551110 points
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    尊敬的 David：

    看起来对6英寸有误解。

    6英寸距离位于 DPHY 重定时器和处理器(CSI-2灌电流)之间。 我无法将 DPHY 重定时器放置在现有板上小于6英寸的位置  

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    TI__Guru**** 2551110 points
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    您好！

    DPHY440 TX 具有2.5dB 的预加重功能、可用于补偿 TX 侧的插入损耗、因此我在这里看不到360Mbps 时的6in 是个问题。 如果处理器模块 RX 具有均衡器、则可以通过 RX 均衡来补偿额外的损耗

    谢谢

    David  

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    TI__Guru**** 2551110 points
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    大家好、David、感谢您的快速回答

    处理器接收模块 没有接收均衡功能。 请确认具有2.5dB 预加重设置的 DPHY 重定时器驱动6英寸 FR4走线。

    请确认要组装哪些电阻器？ R1和 R2=10K？？ 应组装 R7或组装 R8。

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    TI__Guru**** 2551110 points
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    您好！

    只需澄清一下、360Mbps 是总数据速率还是线速率(每通道的数据速率)？ 您计划使用多少个 MIPI 通道、您的最小高速时钟频率是多少？

    6英寸插入损耗取决于布线宽度、电路板  介电常数等 例如、如果布线宽度为5mil、损耗为~0.15dB/in。 6in 损耗将为0.9dB。 这是布线的估计损耗、但不会增加过孔、连接器等的损耗

    有关 DPHY440的配置、请参阅 第8.2.2节"详细设计流程"。

    谢谢

    David

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    TI__Guru**** 2551110 points
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    尊敬的 David：

    摄像头传感器接口仅使用1 MIPI CLK 通道+ 1数据通道。 摄像机传感器支持代码段中的速度以下。

    请确认。

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    TI__Guru**** 2551110 points
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    您好！

    您的帖子中缺少该图片、您是否会再次附上该图片？

    第8.2.2节是否回答您对 DPHY440配置的问题？

    谢谢

    David

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    TI__Guru**** 2551110 points
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    尊敬的 David：

    我已开始在设计中测试 DPHY440重定时器。 我在数据通道上获得开始传输多位错误。  

    下面是处理器寄存器位描述。

    "CILA_DATA_LANE0_SOT_MB_ERR：传输开始多位错误。 当 CIL-A 检测到一个多通道时置1
    数据通道0上的其中一个数据包 SOT 字节中的传输字节错误的位开始。 数据包将是
    被丢弃。”   

     DPHY440配置如下：

    • VSADJ_CFG0：以10K 电阻上拉
    • PRE_CFG1：以10K 电阻上拉
    • EQ / SCL：下拉

    请建议解决该问题。

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    TI__Guru**** 2551110 points
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    您好！

    我可以看一下您的原理图和布局吗？ 迹线在 DPHY440之前和 DPHY440之后有多长时间？

    您是否仅看到通道0上的错误、是否有可用于探测故障通道的示波器？

    谢谢

    David