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[参考译文] DS90UB960-Q1:DS90UB960-Q1和 Nivida Jetson TX2之间存在 MIPI CSI-2错误

Guru**** 2541290 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/952083/ds90ub960-q1-mipi-csi-2-errors-between-ds90ub960-q1-and-nivida-jetson-tx2

器件型号:DS90UB960-Q1

硬件配置如下:

传感器-> TI DS90UB953 (串行器)--- TI DS90UB960 (解串器)-> TX2 MIPI CSI2 (4通道)

问题是:

如果 UB960 (解串器)的 MIPI 通道位速率设置为1.6Gbps (1x4lane)、TX2无法从 MIPI CSI2接收图像数据、

而对于800Mbps MIPI 通道(1x4通道)、一切都正常。

我们还使用960的图形发生器测试 MIPI CSI-2通信、

而不是来自图像传感器的输入。

出现同样的问题。

960和 Jetson tx2之间的 MIPI-CS-2接口似乎存在问题。

我们还根据960的数据表"10.1.3 CSI-2指南"仔细检查了 PCB 布线延迟。

我们确认 MIPI CSI-2布线和布局满足以下要求:

  1. 最大布线长度小于2800mil、约小于540ps。
  2. 线对内长度不匹配小于5mil、因此线对内偏移小于1ps;
  3. 线对间长度不匹配小于10mil、因此线对间偏移小于5ps。

当我们尝试在 Nvidia Jetson TX2上捕获图像时、 内核会输出一些与 MIPI CSI-2相关的错误、

显示 MIPI 数据包中存在一些 CRC/ECC 错误。

800Mbps 和1.6Gbps MIPI 数据速率之间有何差异?

应该针对1.6Gbps 数据速率调整960的 MIPI CSI-2时序参数吗?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Fred、

    感谢本例的详细调试。 您很高兴拥有这一分步记录。

    您认为问题可能来自960 CSI2 I/f 和 Jetson TX2之间的部分。

    由于 TX2端存在 CRC/ECC 错误、因此可能是 CSI2链路抖动裕度问题:

    1.确保 TX2可支持高达1.6Gbps 的 CSI2数据速率

    2.如果可能、您可以使用 MIPI 分析器测试1.6Gbps DPHY 信号并检查规格。 不满足要求

    3.请检查您的电路板是否具有串扰、这使得 CSI2链路处于边缘状态  

    对于960、1.6Gbps 物理层满足 mipi csi2合规性测试。 您可以专注于 CSI2 I/f 抖动裕度设计。

    此致、

    Steven

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    您好 Steven,  

    我们今天进行了一些进一步的测试。

    采用相同的960和 TX2 MIPI 配置(寄存器设置)、

    953 / 960 PG 在2-lane@1.2Gbps 和2-lane@1.6Gbps 条件下工作正常、

    但 4-lane@1.2Gbps 和4-lane@1.6Gbp s 失败

    MIPI 数据通道 D0、D1工作正常、  

    但 MIPI 通道 D2 D3有问题。

    有什么想法吗?

    是否可以切换为在 MIPI 通道 D2和 D3上路由数据、而不是使用2-lane@1.6Gbps 进行 D0和 D1?

    此致、

    Fred

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    还可以。 它进一步表明这是 CSI2链路抖动裕度问题。 请按照上面的建议进行检查、重点是链路抖动裕度分析。

    此致、

    Steven

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    Steven,ñ o

    您是指 CSI2时钟抖动吗?

    您能否详细解释一下如何进行抖动裕度分析?

    或者向我推荐一些工具?

    谢谢。

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    您好!

    我更关注数据通道(lane2/lane3)抖动性能。 您可以使用 Tek 或 Keysight 的 MIPI 分析仪仪器来捕获这两个通道的电气规格。 基于 MIPI 一致性规范。 来自 MIPI 组织。

    此致、

    Steven